參數(shù)資料
型號(hào)： MC68349FT25
廠商： MOTOROLA INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 32-BIT, MICROCONTROLLER, PQFP16
封裝： PLASTIC, QFP-160
文件頁(yè)數(shù)： 100/420頁(yè)
文件大?。?/td> 1645K
代理商： MC68349FT25
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5- 34
MC68349 USER’S MANUAL
MOTOROLA
After initial instruction prefetches, normal program execution begins at the address in the
PC. The reset exception does not save the value of either the PC or the SR.
If a bus error or address error occurs during reset exception processing, a double bus fault
occurs, the processor halts, and the HALT signal is asserted to indicate the halted
condition.
Execution of the RESET instruction does not cause a reset exception nor does it affect
any internal CPU register. The SIM49 registers and the module control register in each
internal peripheral module (DMA, quad data memory module (QDMM), and serial
modules) are not affected. All other internal peripheral module registers are reset the
same as for a hardware reset. The external devices connected to the RESET signal are
reset at the completion of the RESET instruction.
5.6.2.2 BUS ERROR. A bus error exception occurs when an assertion of the BERR signal
is acknowledged. The BERR signal can be asserted by one of three sources:
1. External logic by assertion of the BERR input pin
2. Direct assertion of the internal BERR signal by an internal module
3. Direct assertion of the internal BERR signal by the on-chip hardware watchdog
after detecting a no-response condition
Bus error exception processing begins when the processor attempts to use information
from an aborted bus cycle.
When the aborted bus cycle is an instruction prefetch, the processor will not initiate
exception processing unless the prefetched information is used. For example, if a branch
instruction flushes an aborted prefetch, that word is not accessed, and no exception
occurs.
When the aborted bus cycle is a data access, the processor initiates exception processing
immediately, except in the case of released operand writes. Released write bus errors are
delayed until the next instruction boundary or until another operand access is attempted.
Exception processing for bus error exceptions follows the regular sequence, but context
preservation is more involved than for other exceptions because a bus exception can be
initiated while an instruction is executing. Several bus error stack format organizations are
utilized to provide additional information regarding the nature of the fault.
First, any register altered by a faulted-instruction EA calculation is restored to its initial
value. Then an SSW is placed on the stack. The SSW contains specific information about
the aborted access—size, type of access (read or write), bus cycle type, and function
code. Finally, fault address, bus error exception vector number, PC value, and a copy of
the SR are saved.
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PDF描述
MC68356CZP25 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357
MC68356ZP25 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357
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MC68A40L 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28
MC68A40CL 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28
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參數(shù)描述
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MC68349V 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR
MC6835 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS
MC68360 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual
MC68360AD 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:MC68360 QUad Integrated Communication Controller (QUICCa?￠)
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