參數(shù)資料
型號： M32185F4VFP
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144
文件頁數(shù)： 549/1032頁
文件大?。?/td> 5750K
代理商： M32185F4VFP
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SERIAL INTERFACE
12
12-15
32185/32186 Group Hardware Manual
Rev.1.10 REJ09B0235-0110 May 15, 07
12.2.3 SIO Transmit/Receive Mode Registers
SIO0 Transmit/Receive Mode Register (S0MOD)
<Address: H'0080 0111>
SIO1 Transmit/Receive Mode Register (S1MOD)
<Address: H'0080 0121>
SIO2 Transmit/Receive Mode Register (S2MOD)
<Address: H'0080 0131>
SIO3 Transmit/Receive Mode Register (S3MOD)
<Address: H'0080 0141>
SIO4 Transmit/Receive Mode Register (S4MOD)
<Address: H'0080 0A11>
SIO5 Transmit/Receive Mode Register (S5MOD)
<Address: H'0080 0A21>
b0
123456
b7
CKPOL
00000000
SEL3PNT
SELFST
SELCLK
CSIBL
<Upon exiting reset: H’00>
b
Bit Name
Function
R
W
8–10
SMOD
b8 b9 b10
R
W
Serial interface mode select bit
0
0 : 7-bit UART
(Note 1)
0
1 : 8-bit UART
0
1
X : 9-bit UART
1
X
X : 8
16-bit CSIO (Note 4)
11
CKS
0: Internal clock
R
W
Internal/external clock select bit
1: External clock
(Note 2)
12
STB
0: One stop bit
R
W
Stop bit length select bit, UART mode only
1: Two stop bits
(Note 3)
13
PSEL
0: Odd parity
R
W
Odd/even parity select bit, UART mode only
1: Even parity
(Note 3)
14
PEN
0: Disable parity
R
W
Parity enable bit, UART mode only
1: Enable parity
(Note 3)
15
SEN
0: Disable sleep function
R
W
Sleep select bit, UART mode only
1: Enable sleep function
(Note 3)
Note 1: For SIO2 and 3, bit 8 is fixed to "0" in hardware. This bit cannot be set to "1" in software (to select clock-synchronous serial
interface).
Note 2: Has no effect when UART mode selected.
Note 3: Bits 12–15 have no effect during clock-synchronous mode.
Note 4: The selection of CSIO bit length is made with the SIOn Special Mode Register (SnSMOD).
The SIO Transmit/Receive Mode Registers consist of bits to set the serial interface operation mode, data
format and the functions used during communication.
The SIO Transmit/Receive Mode Registers must always be set before the serial interface starts operating.
To change register settings after the serial interface starts sending or receiving data, first confirm that
transmit and receive operations have finished and then disable transmit/receive operations (by clearing
the SIO Transmit Control Register transmit enable bit and SIO Receive Control Register receive enable bit
to "0") before making changes.
(1) SMOD (Serial Interface Mode Select) bits (Bits 8–10)
These bits select the operation mode of serial interface.
(2) CKS (Internal/External Clock Select) bit (Bit 11)
This bit is effective when CSIO mode is selected. Setting this bit has no effect when UART mode is
selected, in which case the serial interface is clocked by the internal clock.
12.2 Serial Interface Related Registers
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