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參數(shù)資料
| 型號： | LSIFC909 |
| 英文描述： | LSIFC909 Fibre Channel I/O Processor technical manual v2.1 8/00 |
| 中文描述： | LSIFC909光纖通道I / O處理器技術(shù)手冊2.1 8 / 00 |
| 文件頁數(shù)： | 78/144頁 |
| 文件大?。?/td> | 1496K |
| 代理商： | LSIFC909 |
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5-22
Registers
NIPtr
Next_Item_Pointer
Bits [15:8] contain the offset location of the next item in
the function capabilities list. The LSIFC909 has these bits
set to zero indicating no further extended capabilities
registers exist.
[15:8]
CapID
Capabilities ID
These bits indicate the type of data structure currently
being used. The bits are set to 0x01, indicating the Power
Management Data Structure.
[7:0]
Register: 0x44
Power Management Control/Status
Read/Write
PMData
Power Management Data
These bits provide an optional mechanism for the
function to report state-dependent operating data. The
LSIFC909 always returns 0x00. These bits are read only.
[31:24]
PMCSR-BSE
Bridge Support Extensions
These bits indicate PCI Bridge specific functionality. The
LSIFC909 always returns 0x00. These bits are read only.
[23:16]
PST
PME_Status
The LSIFC909 always returns a zero for this bit,
indicating that PME signal generation is not supported
from D3cold.
15
DSCL[1:0]
Data_Scale
The LSIFC909 does not support the data register.
Therefore, these two bits default to 0. The host can
program these bits and the LSIFC909 will retain the
programmed value; however, the value is not used since
the data register is not implemented in the LSIFC909.
[14:13]
31
24
23
16
PMData
PMCSR-BSE
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
15
14
13
12
9
8
7
2
1
0
PST
DSCL[1:0]
DSLT[3:0]
PEN
R
PWS[1:0]
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
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