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參數(shù)資料
| 型號： | LSIFC909 |
| 英文描述： | LSIFC909 Fibre Channel I/O Processor technical manual v2.1 8/00 |
| 中文描述： | LSIFC909光纖通道I / O處理器技術(shù)手冊2.1 8 / 00 |
| 文件頁數(shù)： | 76/144頁 |
| 文件大小： | 1496K |
| 代理商： | LSIFC909 |
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5-20
Registers
Register: 0x3C
Latency/Interrupt
Read/Write
MaxLat
Maximum Latency (Read Only)
This value has been set to a small number (0x08) to
request small latencies for PCI arbitration.
[31:24]
MinGnt
Minimum Grant (Read Only)
This value has been set to a large number (0x1E) to
indicate that the LSIFC909 is capable of large burst
transfers.
[23:16]
IntPin
Interrupt Pin (Read Only)
This register tells which interrupt pin the device uses. Its
value is set to 0x01, for the INTA/ signal.
[15:8]
IntLin
Interrupt Line (Read/Write)
This register is used to communicate interrupt line routing
information. POST software will write the routing
information into this register as it initiates and configures
the system. The value in this register tells which input of
the system interrupt controller(s) the device interrupt pin
has been connected to. Values in this register are
specified by system architecture.
[7:0]
31
24
23
16
MaxLat
MinGnt
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
15
8
7
0
IntPin
IntLin
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
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