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參數(shù)資料
| 型號： | IXF1010 |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 10 CHANNEL(S), 1000M bps, LOCAL AREA NETWORK CONTROLLER, CBGA552 |
| 封裝： | 25 X 25 MM, 1 MM PITCH, CERAMIC, BGA-552 |
| 文件頁數(shù)： | 93/116頁 |
| 文件大?。?/td> | 1392K |
| 代理商： | IXF1010 |
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IXF1010 — 10-Port 100/1000 Mbps Ethernet MAC
78
Preliminary Datasheet
Document #: 249839
Revision #: 001
Rev. Date: April 29, 2002
Table 49. Pause Threshold Register (Addr: Port_Index + 0x0E)
Bit
Name
Description
Type1
Default
31:16
Reserved
RO
0x0000
15:0
Pause
Threshold
When a pause frame is sent, an internal timer checks
when a new pause frame must be scheduled for
transmission to keep the link partner in pause mode.
The pause threshold value is the minimum time to
send before the earlier pause frame is aged out.
R/W
0x002F
1. RO = Read Only; RR = Clear on Read; W = Write; R/W = Read/Write
Table 50. Max Frame Size Register (Addr: Port_Index + 0x0F)
Bit
Name
Description
Type1
Default
31:14
Reserved
RO
0x0000
13:0
MaxFrameSize
The maximum frame size the MAC can receive or
transmit without activating any error counters, and
without truncation.
The maximum frame size is internally adjusted by +4
if VLAN is tagged.
R/W
0x05EE
1. RO = Read Only; RR = Clear on Read; W = Write; R/W = Read/Write
Table 51. RGMII Speed Register (Addr: Port_Index + 0x10)
Bit
Name
Description
Type1
Default
31:2
Reserved
RO
0x00000000
1:0
RGMII Speed
These bits are used to define the speed of the
IXF1010 operation.
01 = 100 Mbps - RGMII TX_CLK is 25 MHz
1x = 1 Gbps - RGMII TX_CLK is 125 MHz
R/W
11
1. RO = Read Only; RR = Clear on Read; W = Write; R/W = Read/Write
Table 52. FC Enable Register Bit Definition (Addr: Port_Index + 0x12)
Bit
Name
Description
Type1
Default
Register Description: Indicates flow control settings of the IXF1010.
31:2
Reserved
RO
0x00000001
1TXFDFC
1 = Enable TX FD Flow Control
0 = Disables
R/W
1
0RXFDFC
1 = Enable RX FD Flow Control
0 = Disables
R/W
1
1. RO = Read Only; RR = Clear on Read; W = Write; R/W = Read/Write
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PDF描述 |
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