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參數(shù)資料
| 型號： | IXF1010 |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 10 CHANNEL(S), 1000M bps, LOCAL AREA NETWORK CONTROLLER, CBGA552 |
| 封裝： | 25 X 25 MM, 1 MM PITCH, CERAMIC, BGA-552 |
| 文件頁數(shù)： | 46/116頁 |
| 文件大?。?/td> | 1392K |
| 代理商： | IXF1010 |
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10-Port 100/1000 Mbps Ethernet MAC — IXF1010
Preliminary Datasheet
35
Document #: 249839
Revision #: 001
Rev. Date: April 29, 2002
3.3.4
TXERR and RXERR Coding
To reduce interface power, the transmit error condition (TXERR) and the receive error condition
(RXERR) are encoded on the RGMII interface to minimize transitions during normal network
operation (refer to Table 10 on page 35 for the encoding method). Table 9 provides signal
definitions for RGMII. Figure 10 shows the transitions for frames with and without errors.
Note:
The value of RGMII_TXER and RGMII_TXEN are valid at the rising edge of the clock while
TXERR is presented on the falling edge of the clock. RXERR coding behaves in the same way.
TXERR <= RGMII_TXER (XOR) RGMII_TXEN
RXERR <= RGMII_RXER (XOR) RGMII_RXDV
Table 9.
RGMII Signal Definitions
IXF1010 Symbol
RGMII Standard
Symbol
Source
Description
TXC
MAC
Depending on speed, the transmit reference clock is
125 MHz or 25 MHz +/- 100 ppm.
TD[3:0]_n
TD<3:0>
MAC
Contains Register bits 3:0 on the rising edge of TXC and
Register bits 7:4 on the falling edge of TXC
TX_CTL
MAC
TXEN on the rising edge of TXC
TXEN xor TXERR on the falling edge of TXC
RXC
PHY
Continuous reference clock is 125 MHz or 25 MHz
+/- 100 ppm
RD[3:0]_n
RD<3:0>
PHY
Contains Register bits 3:0 on the rising edge of RXC and
Register bits 7:4 on the falling edge of RXC
RX_CTL
PHY
RX_CTL is on the rising edge of RXC
RX_CTL xor RXERR is the falling edge of RXC
Table 10. TXERR and RXERR Coding Example
Condition
Description
Receiving valid frame, no errors
RX_CTL = true
Logic High on rising edge of RXC
RXERR = false
Logic High on the falling edge of
RXC
Receiving valid frame, with errors
RX_CTL = true
Logic High on rising edge of RXC
RXERR = true
Logic Low on the falling edge of RXC
Receiving invalid frame (or no
frame)
RX_CTL = false
Logic Low on rising edge of RXC
RXERR = false
Logic Low on the falling edge of RXC
NOTE: Refer to Figure 10 for TX_CTL Behavior.
相關(guān)PDF資料 |
PDF描述 |
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| JAN1N3595US-1 | 0.15 A, SILICON, SIGNAL DIODE |
| JANTXV1N3595US-1 | 0.15 A, SILICON, SIGNAL DIODE |
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