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參數(shù)資料
| 型號： | IXF1010 |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 10 CHANNEL(S), 1000M bps, LOCAL AREA NETWORK CONTROLLER, CBGA552 |
| 封裝： | 25 X 25 MM, 1 MM PITCH, CERAMIC, BGA-552 |
| 文件頁數(shù)： | 91/116頁 |
| 文件大?。?/td> | 1392K |
| 代理商： | IXF1010 |
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IXF1010 — 10-Port 100/1000 Mbps Ethernet MAC
76
Preliminary Datasheet
Document #: 249839
Revision #: 001
Rev. Date: April 29, 2002
6.5.1
MAC Control Registers
Table 40 through Table 58 on page 81provide details on the control and status registers associated
with each MAC port. The register address is ‘Port_index + 0x**’, where the port index is set at
any value from 0x0 through 0x5. All registers are 32 bits.
Table 40. Station Address Register (Low) (Addr: Port_Index + 0x00)
Bit
Name
Description
Type1
Default
31:0
StationAddress
Low
Source MAC address bit 31-0.
This address is inserted in the source address field
when transmitting Pause frames, and is also used to
compare against unicast Pause frames at the
receiving side.
R/W
0x00000000
1. RO = Read Only; RR = Clear on Read; W = Write; R/W = Read/Write
Table 41. Station Address Register (High) (Addr: Port_Index + 0x01)
Bit
Name
Description
Type1
Default
31:16
Reserved
RO
0x0000
15:0
StationAddress
High
Source MAC address bit 47-32.
This address is inserted in the source address field
when transmitting Pause frames, and is also used to
compare against unicast Pause frames at the
receiving side.
R/W
0x0000
1. RO = Read Only; RR = Clear on Read; W = Write; R/W = Read/Write
Table 42. FDFC Type Register (Addr: Port_Index + 0x03)
Bit
Name
Description
Type1
Default
31:16
Reserved
RO
0x0000
15:0
FDFCType
Contains the value of the type field transmitted in an
internally generated flow control (pause) frame.
Internally generated flow control frames are
generated via the external pause interface or when
the RX FIFO exceeds its high watermark.
R/W
0x8808
1. RO = Read Only; RR = Clear on Read; W = Write; R/W = Read/Write
Table 43. FC TX Timer Value Register (Addr: Port_Index + 0x07)
Bit
Name
Description
Type1
Default
31:16
Reserved
RO
0x0000
15:0
FCTxTimer
Value
The pause length sent to the receiving station in 512
bit times
R/W
0x005E
1. RO = Read Only; RR = Clear on Read; W = Write; R/W = Read/Write
相關(guān)PDF資料 |
PDF描述 |
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| JAN1N3595US-1 | 0.15 A, SILICON, SIGNAL DIODE |
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參數(shù)描述 |
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