參數(shù)資料
型號： GCIXP1250-232
英文描述： Microprocessor
中文描述： 微處理器
文件頁數(shù)： 82/148頁
文件大小： 1601K
代理商： GCIXP1250-232
Intel
IXP1250 Network Processor
82
Datasheet
4.3.7.2
IX Bus Signals Timing
Figure 20. IX Bus Signals Timing
Table 45. IX Bus Signals Timing
Symbol
Parameter
Minimum
(IX Bus Speed)
Maximum
(IX Bus Speed)
Unit
Condition
66
MHz
85
MHz
104
MHz
66
MHz
85
MHz
104
MHz
T
val
Clock to output delay
1.0
1.0
0.5
7.0
7.0
5.75
ns
0 pF load
1
1. Capacitive loading effects on signal lines are shown in
Table 46
.
2. The parameter specified is guaranteed by design in a minimally configured system environment.
T
su
Data input setup time before
clock
4.0
4.0
3.25
---
---
---
ns
T
h
Data input hold time from
clock
1.0
1.0
0.25
---
---
---
ns
T
on
Float to FDAT[63:0] and
FBE_L[7:0] data driven delay
from clock
1.5
1.5
1.5
--
--
--
ns
T
onxf
Float to data driven from
clock, excluding FDAT[63:0]
and FBE_L[7:0]
2.5
2.5
2.5
--
--
--
ns
T
off
FDAT[63:0] and FBE_L[7:0]
driven to float delay from
clock
---
---
---
7.5
7.5
7.5
ns
T
offxf
Data driven to float delay,
excluding FDAT[63:0] and
FBE_L[7:0]
---
---
---
7.0
7.0
7.0
ns
A8559-01
T
val(max)
T
su
T
h
T
val(min)
T
on
T
off
CLK
Outputs
Inputs
相關(guān)PDF資料
PDF描述
GCK101 Analog IC
GCK131 Microcontroller
GCM-3.15A Fuse
GCM-4A Fuse
GCM-5A Fuse
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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GCJ0335C5C1AR50D 制造商:MURATA 制造商全稱:Murata Manufacturing Co., Ltd. 功能描述:Chip Monolithic Ceramic Capacitors
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