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參數(shù)資料
| 型號： | BT849A |
| 英文描述： | Single-Chip Video Capture for PCI |
| 中文描述： | 單芯片的PCI視頻捕捉 |
| 文件頁數(shù)： | 99/141頁 |
| 文件大?。?/td> | 1149K |
| 代理商： | BT849A |
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Brooktree
89
C
ONTROL
R
EGISTER
D
EFINITIONS
Interrupt Line, Interrupt Pin, Min_Gnt, Max_Lat Register
L848A_A
Bt848/848A/849A
Single-Chip Video Capture for PCI
Interrupt Line, Interrupt Pin, Min_Gnt, Max_Lat Register
PCI Configuration Header Location 0x3C
Min_Gnt and Max_Lat values are dependent on target performance (TRDY) and video mode (scale factors and color
format). These values were chosen for best case target (0 wait-state) and worst-case video delivery (full-resolution
32-bit RGB).
Bits
Type
Default
Name
Description
[31:25]
RO
0x28
Max_Lat
Require bus access every 8.5
μ
S, at a minimum, in units of
250nS. Affects the desired settings for the latency timer value.
[24:16]
RO
0x10
Min_Gnt
Desire a minimum grant burst period of 4
μ
S to empty data FIFO,
in units of 250nS. Affects the desired settings for the latency timer
value. Set for 128 dwords, with 0 wait states.
[15:8]
RO
0x01
Interrupt Pin
Bt848 interrupt pin is connected to INTA, the only one usable by a
single function device.
[7:0]
RW
Interrupt Line
The Interrupt Line register communicates interrupt line routing
information between the POST code and the device driver. The
POST code initializes this register with a value specifying to which
input (IRQ) of the system interrupt controller the Bt848 interrupt
pin is connected. Device drivers can use this value to determine
interrupt priority and vector information.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| BT8510EPJC | PCM Transceiver |
| BT857KPJ | Color Encoder Circuit |
| BT8958EHJ50 | xDSL Interface |
| BT8953AEPFC | xDSL Interface |
| BT8953AEPJ | xDSL Interface |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| BT849AKPF | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Single-Chip Video Capture for PCI |
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| BT850-ST | 功能描述:BTV4.2 DUAL MODE USB HCI MODULE 制造商:laird - wireless & thermal systems 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1 |
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