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參數(shù)資料
| 型號(hào)： | BT849A |
| 英文描述： | Single-Chip Video Capture for PCI |
| 中文描述： | 單芯片的PCI視頻捕捉 |
| 文件頁數(shù)： | 94/141頁 |
| 文件大?。?/td> | 1149K |
| 代理商： | BT849A |
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Bt848/848A/849A
Single-Chip Video Capture for PCI
Brooktree
84
C
ONTROL
R
EGISTER
D
EFINITIONS
PCI Configuration Space
L848A_A
The Bt848 is a single-function device, and only supports type 0 configuration
cycles. The configuration space registers are stored in dwords and defined by byte
addresses. Therefore a register one byte in length can have a bit definition other
than [7:0] (for example [31:24]), depending on its location in the configuration
space. For a discussion on configuration cycle addressing, refer to Section 3.6.4.1
of the
PCI Local Bus Specification, Revision 2.1
.
The configuration space is accessible at all times even though it is not typically
accessed during normal operation. These registers are normally accessed by the
Power On Self Test (POST) code and by the device driver during initialization
time. Software will however read the status register during normal operation when
a PCI bus error occurs and is detected by Bt848.
The Configuration Space is accessed when the Initialization Device Select (ID-
SEL) pin is high, and AD[1:0] = 00, otherwise the cycle is ignored. The configu-
ration register addresses are each offset by 4, since AD[1:0] = 00.
Bt848 supports burst R/W cycles. Write operations to reserved, unimplemented,
or read-only registers/bits complete normally with the data discarded. Read ac-
cesses to reserved or unimplemented registers/bits return a data value equal to ze-
ro.
Figure 41. PCI Configuration Space Header
Device ID
Vendor ID
Status
Command
Class Code
Revision ID
0x00
0x04
0x08
0x0C
0x10
0x14
0x18
0x1C
0x20
0x24
0x28
0x2C
0x30
0x34
0x38
0x3C
Reserved
Reserved
Reserved
Reserved
Reserved
Interrupt Pin
Interrupt Line
31
16 15
0
Base Address 0 Register
Reserved
Reserved
Reserved
Latency Timer
Reserved
Max_Lat
Min_Gnt
Header Type 0
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PDF描述 |
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