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參數(shù)資料
| 型號： | BT849A |
| 英文描述： | Single-Chip Video Capture for PCI |
| 中文描述： | 單芯片的PCI視頻捕捉 |
| 文件頁數(shù)： | 116/141頁 |
| 文件大?。?/td> | 1149K |
| 代理商： | BT849A |
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Bt848/848A/849A
Single-Chip Video Capture for PCI
Brooktree
106
C
ONTROL
R
EGISTER
D
EFINITIONS
ADC Interface Register
L848A_A
ADC Interface Register
Memory Mapped Location 0x068 – (ADC)
Upon reset, it is initialized to 0x82. CRUSH is the least significant bit.
Bits
Type
Default
Name
Description
[7:6]
RW
10
Reserved
These bits should only be written with logical one and logical zero.
[5]
RW
0
SYNC_T
This bit defines the voltage level below which the SYNC signal can
be detected.
0
= Analog SYNCDET threshold high (~125 mV)
1
= Analog SYNCDET threshold low (~75 mV)
SYNC_T
This bit is reserved in the Bt848A and Bt849A and must be set to
zero.
[4]
RW
0
AGC_EN
This bit controls the AGC function. If disabled REFOUT is not
driven and an external reference voltage must be provided. If
enabled, REFOUT is driven to control the A/D reference voltage.
0
= AGC Enabled
1
= AGC Disabled
[3]
RW
0
CLK_SLEEP
When this bit is at a logical one, the decoder clock is powered
down, but the device registers are still accessible. Recovery time is
approximately one second to return to capturing video.
0
= Normal Clock Operation
1
= Shut down the System Clock (Power Down)
[2]
RW
0
Y_SLEEP
This bit enables putting the luma ADC in sleep mode.
0
= Normal Y ADC operation
1
= Sleep Y ADC operation
[1]
RW
1
C_SLEEP
This bit enables putting the chroma ADC in sleep mode.
0
= Normal C ADC operation
1
= Sleep C ADC operation
[0]
RW
0
CRUSH
When the CRUSH bit is high (adaptive AGC), the gain control
mechanism monitors the A/D’s for overflow conditions. If an over-
flow is detected, the REFOUT voltage is increased, which
increases the input voltage range on the A/D’s.
0
= Non-adaptive AGC
1
= Adaptive AGC
相關(guān)PDF資料 |
PDF描述 |
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