參數(shù)資料
型號： AD9520-5/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 2/76頁
文件大?。?/td> 0K
描述： BOARD EVAL FOR AD9520-5
設(shè)計(jì)資源： Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121)
Phase Coherent FSK Modulator (CN0186)
AD9520 Eval Brd Schematic
AD9520 BOM
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘發(fā)生器
已用 IC / 零件： AD9520-5
已供物品： 板
AD9520-5
Data Sheet
Rev. A | Page 10 of 76
CLOCK OUTPUT ADDITIVE PHASE NOISE (DISTRIBUTION ONLY; VCO DIVIDER NOT USED)
Table 6.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CLK-TO-LVPECL ADDITIVE PHASE NOISE
Distribution section only; does not include the PLL
CLK = 1 GHz, Output = 1 GHz
Input slew rate > 1 V/ns
Divider = 1
10 Hz Offset
107
dBc/Hz
100 Hz Offset
117
dBc/Hz
1 kHz Offset
127
dBc/Hz
10 kHz Offset
135
dBc/Hz
100 kHz Offset
142
dBc/Hz
1 MHz Offset
145
dBc/Hz
10 MHz Offset
147
dBc/Hz
100 MHz Offset
150
dBc/Hz
CLK = 1 GHz, Output = 200 MHz
Input slew rate > 1 V/ns
Divider = 5
10 Hz Offset
122
dBc/Hz
100 Hz Offset
132
dBc/Hz
1 kHz Offset
143
dBc/Hz
10 kHz Offset
150
dBc/Hz
100 kHz Offset
156
dBc/Hz
1 MHz Offset
157
dBc/Hz
>10 MHz Offset
157
dBc/Hz
CLK-TO-CMOS ADDITIVE PHASE NOISE
Distribution section only; does not include the PLL
CLK = 1 GHz, Output = 250 MHz
Input slew rate > 1 V/ns
Divider = 4
10 Hz Offset
107
dBc/Hz
100 Hz Offset
119
dBc/Hz
1 kHz Offset
125
dBc/Hz
10 kHz Offset
134
dBc/Hz
100 kHz Offset
144
dBc/Hz
1 MHz Offset
148
dBc/Hz
>10 MHz Offset
154
dBc/Hz
CLK = 1 GHz, Output = 50 MHz
Input slew rate > 1 V/ns
Divider = 20
10 Hz Offset
126
dBc/Hz
100 Hz Offset
133
dBc/Hz
1 kHz Offset
140
dBc/Hz
10 kHz Offset
148
dBc/Hz
100 kHz Offset
157
dBc/Hz
1 MHz Offset
160
dBc/Hz
>10 MHz Offset
163
dBc/Hz
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PDF描述
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參數(shù)描述
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AD9521KH 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier
AD9521SE 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier
AD9521SH 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier
AD9521TE 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier
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