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參數(shù)資料
| 型號： | AD9520-5/PCBZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 18/76頁 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD9520-5 |
| 設(shè)計資源： | Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121) Phase Coherent FSK Modulator (CN0186) AD9520 Eval Brd Schematic AD9520 BOM |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 主要目的： | 計時，時鐘發(fā)生器 |
| 已用 IC / 零件： | AD9520-5 |
| 已供物品： | 板 |
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Data Sheet
AD9520-5
Rev. A | Page 25 of 76
DETAILED BLOCK DIAGRAM
Figure 26.
PROGRAMMABLE
N DELAY
REFIN
CLK
REF1
REF2
BUF
AMP
AD9520-5
STATUS
R
DI
V
IDE
R
CL
O
CK
DO
UBL
E
R
STATUS
P
RO
G
RAM
M
ABL
E
R
DE
L
AY
REFERENCE
SWITCHOVER
REF_SEL
CPRSET VCP
VS
GND
RSET
DISTRIBUTION
REFERENCE
REFMON
CP
VS_DRV
STATUS
LD
P, P + 1
PRESCALER
A/B
COUNTERS
N DIVIDER
PHASE
FREQUENCY
DETECTOR
LOCK
DETECT
CHARGE
PUMP
PL
L
RE
F
E
RE
NCE
HOLD
0
1
DIVIDE BY 1,
2, 3, 4, 5, OR 6
PD
SYNC
REFIN
RESET
EEPROM
DIGITAL
LOGIC
EEPROM
DIVIDE BY
1 TO 32
OUT0
OUT1
OUT2
DIVIDE BY
1 TO 32
OUT3
OUT4
OUT5
DIVIDE BY
1 TO 32
OUT6
OUT7
OUT8
DIVIDE BY
1 TO 32
OUT9
OUT10
OUT11
ZERO DELAY BLOCK
L
VPEC
L
/C
MO
S
O
U
T
PU
T
SP1
SP0
SPI
INTERFACE
I2C
INTERFACE
SCLK/SCL
SDIO/SDA
SDO
CS
SERIAL
PORT
DECODE
OPTIONAL
07239-
028
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ACM06DRYN | CONN EDGECARD 12POS DIP .156 SLD |
| SPD42R-823M | INDUCTOR PWR SHIELDED 82UH SMD |
| EBA30DTKS | CONN EDGECARD 60POS DIP .125 SLD |
| CDK2000-LCO | KIT EVAL PROTOTYPING CS2300-CP |
| ECE-T2GP821FA | CAP ALUM 820UF 400V 20% SNAP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD9521JH | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier |
| AD9521KH | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier |
| AD9521SE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier |
| AD9521SH | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier |
| AD9521TE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier |
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