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參數(shù)資料
| 型號(hào)： | SII0680A |
| 廠商： | Silicon Image, Inc. |
| 英文描述： | PCI to IDE/ATA |
| 中文描述： | PCI到IDE / ATA的 |
| 文件頁數(shù)： | 120/124頁 |
| 文件大小： | 820K |
| 代理商： | SII0680A |
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SiI0680A PCI to IDE/ATA
Data Sheet
Silicon Image, Inc.
2006 Silicon Image, Inc.
SiI-DS-0069-C
120
13. SiI 0680A Timing Registers
13.1 Timing Register Definition
RECOVERY COUNT TIMING
Bits [21:16] IDE0 Task File Timing + Configuration + Status
Bits [05:00] IDE0 PIO Timing
Bits [21:06] IDE0 PIO Timing
Bits [05:00] IDE1 PIO Timing
Bits [21:06] IDE1 PIO Timing
ACTIVE COUNT TIMING
Bits [27:22] IDE0 Task File Timing + Configuration + Status
Bits [11:06] IDE0 PIO Timing
Bits [27:22] IDE0 PIO Timing
Bits [11:06] IDE1 PIO Timing
Bits [27:22] IDE1 PIO Timing
Value
00h
01h
02h
03h
...
3Fh
ADDRESS SETUP COUNT TIMING
Bits [31:28] IDE0 Task File Timing + Configuration + Status
Bits [15:12] IDE0 PIO Timing
Bits [31:28] IDE0 PIO Timing
Bits [15:12] IDE1 PIO Timing
Bits [31:28] IDE1 PIO Timing
Value
0h
1h
2h
3h
UDMA Cycle Time Count Timing
Value
00h
01h
02h
03h
...
3Fh
In the UDMA timing register. the number of clocks is always 1 greater than the value loaded for the cycle time
count.
The only exception is that value "0" requires two cycles.
Active Time in PCI Clock
1
1
2
3
63
Active Time in PCI Clock
1
1
2
3
Cycle Time in IDE Clock
2
2
3
4
64
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SiI0680ACL144 | PCI to IDE/ATA |
| SiI0680ACLU144 | PCI to IDE/ATA |
| SII0680 | SteelVine⑩ Host Controller |
| SII1000 | PanelLink Receivers |
| SII1151 | TELECOMMANDER USB(PC&Mac OS X) FOR DESKTOP ROVER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SII0680ACL144 | 制造商:SILICONIMAGE 制造商全稱:SILICONIMAGE 功能描述:PCI to IDE/ATA |
| SII0680ACLU144 | 制造商:Silicon Image Inc 功能描述:STEELVINE HOST CONTROLLER |
| SII1000 | 制造商:SILICONIMAGE 制造商全稱:SILICONIMAGE 功能描述:PanelLink Receivers |
| SII100N06 | 制造商:SIRECTIFIER 制造商全稱:Sirectifier Semiconductors 功能描述:NPT IGBT Modules |
| SII100N12 | 制造商:SIRECTIFIER 制造商全稱:Sirectifier Semiconductors 功能描述:NPT IGBT Modules |
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