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參數(shù)資料
| 型號： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 89/158頁 |
| 文件大?。?/td> | 1084K |
| 代理商： | L80227 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁當(dāng)前第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁
Draft 6/5/00
Registers
4-17
Copyright 1999 by LSI Logic Corporation. All rights reserved.
PLED1_[1:0]n Programmable LED 1 Output Select
R/W [11:10]
PLED0_[1:0]n Programmable LED 0 Output Select
R/W [9:8]
LED_DEF_[1:0]
LED Normal Function Select
See
Table 2.8
on
page 2-32
for these bit definitions.
R/W [7:6]
APOL_DIS
Autopolarity Disable
R 5
JAB_DIS
Jabber Disable
R 4
MREG
Multiple Register Access Enable
R 3
PLED1_1n PLED1_0n Meaning
1
1
Normal (PLED1n pin state is determined
from the LED_DEF[1:0] bits (default is
Full-Duplex). 0b11 is the default for these
bits
LED tied to PLED1n blinks (toggles 100
ms LOW, then 100 ms HIGH)
LED tied to PLED1n ON steady (PLED1n
output LOW)
LED tied to PLED1n OFF steady
(PLED1n output HIGH)
1
0
0
1
0
0
PLED3_1n PLED3_0n Meaning
1
1
Normal (PLED0n pin state is determined
from the LED_DEF[1:0] bits (default is
Link 10). 0b11 is the default for these bits
LED tied to PLED0n blinks (toggles 100
ms LOW, then 100 ms HIGH)
LED tied to PLED0n ON steady (PLED0n
output LOW)
LED tied to PLED0n OFF steady
(PLED0n output HIGH)
1
0
0
1
0
0
APOL_DIS
Bit
1
0
Meaning
Autopolarity correction disabled
Normal (default)
JAB_DIS Bit Meaning
1
0
Jabber disabled
Jabber enabled (default)
MREG Bit
1
0
Meaning
Multiple register access enabled
No multiple register access (default)
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