- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377599 > L80227 (LSI CORP) 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號(hào)： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 74/158頁 |
| 文件大?。?/td> | 1084K |
| 代理商： | L80227 |
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Draft 6/5/00
4-2
Registers
Copyright 1999 by LSI Logic Corporation. All rights reserved.
4.1 Bit Types
Because the serial port is bidirectional (capable of both read and write
operations), there are many types of bits. The following bit type
definitions are summarized in
Table 4.1
:
Write bits (W) are inputs during a write cycle and are high
impedance during a read cycle
Read bits (R) are outputs during a read cycle and high impedance
during a write cycle
Read/Write bits (R/W) are actually write bits that can be read out
during a read cycle
R/WSC bits are R/W bits that are self-clearing after a set period of
time or after a specific event has completed
R/LL bits are read bits that latch themselves when they go LOW, and
they stay LOW until read. After they are read, they are reset HIGH.
R/LH bits are the same as R/LL bits, except that they latch HIGH.
R/LT are read bits that latch themselves whenever they make a
transition or change value, and they stay latched until they are read.
After R/LT bits are read, they are updated to their current value.
Table 4.1
MI Register Bit Type Definition
Symbol
Name
Definition
Write Cycle
Read Cycle
W
Write
Input
No operation, Hi-Z
R
Read
No operation, Hi-Z
Output
R/W
Read/Write
Input
Output
R/WSC
Read/Write, Self-Clearing
Input
Output
(clears itself
after the operation completes)
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