- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377599 > L80227 (LSI CORP) 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 51/158頁 |
| 文件大小： | 1084K |
| 代理商： | L80227 |
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Draft 6/5/00
Block Diagram Description
2-31
Copyright 1999 by LSI Logic Corporation. All rights reserved.
2.3.13 LED Drivers
The PLED[5:2] outputs are open-drain with a pullup resistor and can
drive LEDs tied to V
DD
. The PLED[1:0] outputs have both pullup and
pulldown driver transistors with a pullup resistor, so the PLED[1:0]
outputs can drive LEDs tied to either V
DD
or GND.
The PLED[5:0] outputs can be programmed through the MI serial port
Configuration register for the following functions:
Normal Function
On
Off
Blink
The PLED[5:0] outputs are programmed with the LED output select bits
(PLEDn_[1:0]) and the LED Normal Function select bits (LED_DEF[1:0])
in the MI serial port Configuration register.
2.3.13.1 LED Output Select Bits
There are four sets of output select bits in MI serial port Configuration
register, one set for each LED output pin:
PLED3_[1:0] control the PLED3n output
PLED2_[1:0] control the PLED2n output
PLED1_[1:0] control the PLED1n output
PLED0_[1:0] control the PLED0n output
The PLEDn_[1:0] bits program the outputs to operate in the following
modes:
Normal operation (see
Section 2.3.13.2, “LED Normal Function
Select Bits”
)
Blink
Steady On (PLED[3:0]n pin LOW)
Steady Off (PLED[3:0]n pin HIGH)
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