- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377599 > L80227 (LSI CORP) 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 146/158頁 |
| 文件大?。?/td> | 1084K |
| 代理商： | L80227 |
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Draft 6/5/00
A-12
Application Information
Copyright 1999 by LSI Logic Corporation. All rights reserved.
A.7 Repeater Applications
A.7.1 MII Based Repeaters
Using the standard MII as the interface to the repeater core allows the
L80227 to be used as the physical interface for MII based repeaters. For
most repeaters, it is necessary to disable the internal CRS loopback.
For some particular types of repeaters, it may be desirable to either
enable or disable AutoNegotiation, force Half-Duplex operation, and
enable either 100 Mbits/s or 10 Mbits/s operation. Setting the appropriate
bits in the MI serial port Control register can configure these modes.
The MII requires 16 signals between the L80227 and a repeater core.
The MII signal count to a repeater core is 16 multiplied by the number of
ports, which can be quite large. The signal count between the L80227
and a repeater core can be reduced by 8 per device if the receive output
pins are shared and the RX_EN is used to enable only that port where
CRS is asserted. Refer to the
Section A.6.4, “Receive Output Enable,”
page A-11
for more details about RX_EN.
A.7.2 Clocks
Normally, transmit data over the MII is clocked into the L80227 with
edges from the TX_CLK output clock. It may be desirable or necessary
in some repeater applications to clock in the transmit data from a master
clock from the repeater core. This requires that transmit data be clocked
in on edges of an input clock. The OSCIN input clock is available for
clocking in data on TXD. Notice from the timing diagrams that OSCIN
generates TX_CLK, and TXD data is clocked in on TX_CLK edges. This
means that TXD data is also clocked in on OSCIN edges. Thus, an
external clock driving the OSCIN input can also be used as the clock for
TXD.
A.8 Serial Port
The L80227 uses an MI serial port to access the device registers. Any
external device that has a IEEE 802.3 compliant MI interface can connect
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