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參數(shù)資料
| 型號(hào)： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁(yè)數(shù)： | 56/158頁(yè) |
| 文件大小： | 1084K |
| 代理商： | L80227 |
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Draft 6/5/00
2-36
Functional Description
Copyright 1999 by LSI Logic Corporation. All rights reserved.
When the premature end of packet condition is detected, the RX_ER
signal is asserted for the nibble associated with the first /I/ symbol
detected, then the CRS and RX_DV pins are deasserted.
2.5.2 10 Mbits/s
The end of packet for 10 Mbits/s mode is indicated with the SOI (Start
of Idle) pulse. The SOI pulse is a positive double wide pulse containing
a Manchester code violation inserted at the end of every packet.
The TP transmitter generates the transmit SOI pulse and inserts it at the
end of the data packet after TX_EN has been deasserted. The transmit
waveshaper shapes the transmitted SOI output pulse at the TP output to
meet the pulse template requirements specified in IEEE 802.3 Clause 14
and shown in
Figure 2.8
.
Figure 2.8
SOI Output Voltage Template - 10 Mbits/s
The TP receiver senses missing data transitions in order to detect the
receive SOI pulse. Once the SOI pulse is detected, data reception is
ended and the CRS and RX_DV pins are deasserted.
0 BT
4.5 BT
6.0 BT
+ 50 mV
50 mV
45.0 BT
4.5 BT
2.5 BT
3.1 V
0.25 BT
2.25 BT
585 mV
3.1 V
0.5 V/ns
585 mV sin (2
π
(t/1 BT))
0
≤
t
≤
0.25 BT and
225
≤
t
≤
2.5 BT
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