- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377599 > L80227 (LSI CORP) 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 126/158頁 |
| 文件大?。?/td> | 1084K |
| 代理商： | L80227 |
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Draft 6/5/00
6-28
Specifications
Copyright 1999 by LSI Logic Corporation. All rights reserved.
6.4 Pinouts and Package Drawings
This section contains the alphabetical and numerical pin listings for the
L80227 as well as its pinouts and package drawing.
6.4.1 L80227 Pinouts
Table 6.13
and
Table 6.14
contain the list of L80227 signals. The first
table lists the signals by category and the second lists them by pin
number.
Table 6.13
L80227 Pin List (by Signal Category)
Pin Name
Pin Number
Description
Media Interface
REXT
50
Transmit Current Set
TPI -
59
Twisted Pair Receive Input, Negative.
TPI+
58
Twisted Pair Receive Input, Positive.
TPO -
55
Twisted Pair Transmit Output, Negative.
TPO+
54
Twisted Pair Transmit Output, Positive.
Controller Interface
CRS
13
Carrier Sense Output
OSCIN
42
Clock Oscillator Input
RX_CLK
26
Receive Clock Output
RX_DV
14
Receive Data Valid Output
RX_EN
27
Receive Enable Input
RX_ER
18
Receive Error Output
RXD0
22
Receive Data Output.
RXD1
21
Receive Data Output.
RXD2
20
Receive Data Output.
RXD3
19
Receive Data Output
TX_CLK
34
Transmit Clock Output
TX_EN
40
Transmit Enable Input
TX_ER
39
Transmit Error Input
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