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參數(shù)資料
| 型號： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 112/158頁 |
| 文件大?。?/td> | 1084K |
| 代理商： | L80227 |
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Draft 6/5/00
6-14
Specifications
Copyright 1999 by LSI Logic Corporation. All rights reserved.
6.3.3 Receive Timing Characteristics
Table 6.8
shows the Receive AC timing parameters. See
Figure 6.4
through
Figure 6.8
for the receive timing diagrams.
Table 6.8
Receive Timing
Limit
Sym
Parameter
Min
Typ
Max
Unit
Conditions
t31
Start Of Packet To
CRS
Assert Delay
200
ns
100 Mbits/s, MII
700
ns
10 Mbits/s
t32
End Of Packet To
CRS
Deassert Delay
130
240
ns
100 Mbits/s, MII
600
ns
10 Mbits/s. relative to start
of SOI pulse
t33
Start Of Packet To
RX_DV Assert
Delay
240
ns
100 Mbits/s
3600
ns
10 Mbits/s
t34
End Of Packet To
RX_DV Deassert
Delay
280
ns
100 Mbits/s
1000
ns
10 Mbits/s. relative to start
of SOI pulse
t37
RX_CLK To
RX_DV,
RXD, RX_ER
Delay
8
8
ns
100 Mbits/s
80
80
ns
10 Mbits/s
t38
RX_CLK High
Time
18
20
22
ns
100 Mbits/s
180
200
600
ns
10 Mbits/s
t39
RX_CLK Low Time
18
20
22
ns
100 Mbits/s
180
200
600
ns
10 Mbits/s
t40
SOI Pulse
Minimum Width
Required for Idle
Detection
125
200
ns
10 Mbits/s measure TPI
±
from last zero cross to
0.3V point.
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