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參數(shù)資料
| 型號(hào)： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁(yè)數(shù)： | 47/158頁(yè) |
| 文件大?。?/td> | 1084K |
| 代理商： | L80227 |
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Draft 6/5/00
Block Diagram Description
2-27
Copyright 1999 by LSI Logic Corporation. All rights reserved.
capabilities to the remote device’s capabilities and determines what
mode the device should be configured for according to the priority
resolution algorithm defined in IEEEE 802.3 Clause 28. After the
negotiation process is completed, the device configures itself for either
10 or 100 Mbits/s modes and either Half- or Full-Duplex modes
(depending on the outcome of the negotiation process), and switches to
either the 10BASE-T or 100BASE-TX link integrity algorithms (depending
on which mode AutoNegotiation enabled). Refer to IEEE 802.3 Clause
28 for more details.
2.3.10.4 AutoNegotiation Outcome Indication
The outcome or result of the AutoNegotiation process is stored in the
10/100 Speed Detect (SPD_DET) and Duplex Detect (DPLX_DET) bits
in the MI serial port Status Output 0 register.
2.3.10.5 AutoNegotiation Status
To monitor the status of the AutoNegotiation process, simply read the
AutoNegotiation Acknowledgement (ANEG_ACK) bit in the MI serial port
Status register.
2.3.10.6 AutoNegotiation Enable/Disable
To enable the AutoNegotiation algorithm, set the AutoNegotiation Enable
bit (ANEG_EN) in the MI serial port Control register, or assert the ANEG
pin. To disable the AutoNegotiation algorithm, clear the ANEG_EN bit or
deassert the ANEG pin.
When the AutoNegotiation algorithm is enabled, the device halts all
transmissions including link pulses for 1200 to 1500 ms, enters the Link
Fail State, and restarts the negotiation process. When the
AutoNegotiation algorithm is disabled, the selection of 100 Mbits/s or
10 Mbits/s mode is determined with the state of the SPEED bit in the MI
serial port Control register and the half- or full-duplex mode is
determined with the state of the DPLX bit in the MI serial port Control
register.
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