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參數(shù)資料
| 型號： | ISP1362 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Single-chip Universal Serial Bus On-The-Go controller |
| 中文描述： | 單芯片通用串行總線和On - The - Go控制器 |
| 文件頁數(shù)： | 42/150頁 |
| 文件大小： | 647K |
| 代理商： | ISP1362 |
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Philips Semiconductors
ISP1362
Single-chip USB OTG controller
Product data
Rev. 03
—
06 January 2004
42 of 150
9397 750 12337
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
PTD data stored in the HC buffer memory will not be processed unless the respective
control bits (ATL_Active, INTL_Active, ISTL0_BufferFull or ISTL1_BufferFull) in
HcBufferStatus are set.
PTD data in the ATL or interrupt buffer memory can be disabled by setting the
respective skip bit in HcATLSkipMap and HcINTLSkipMap. To skip a particular PTD in
the ATL or interrupt buffer, the HCD may set the corresponding bit of the SkipMap
register. For example, setting the HcATLSkipMap register to 0x0011 will cause
the HC to skip the
fi
rst and the
fi
fth PTDs in the ATL buffer memory.
Certain
fi
elds in the PTD header are used by the HC to inform the HCD about the
status of the transfer. These
fi
elds are indicated by the
‘
Status Update by HC
’
column.
These
fi
elds are updated after every transaction to re
fl
ect the current status of the
PTD.
[1]
All reserved bits should be set to logic 0.
Fig 22. PTD data stored in the buffer memory.
004aaa121
PTD header
buffer memory
payload data
PTD data #1
PTD header
payload data
payload data
PTD header
PTD data #2
PTD data #N
top
bottom
Table 9:
Bit
Byte 0
Byte 1
Byte 2
Byte 3
Byte 4
Byte 5
Byte 6
Byte 7
Generic PTD structure: bit allocation
7
6
5
4
3
2
1
0
ActualBytes[7:0]
CompletionCode[3:0]
Active
Toggle
ActualBytes[9:8]
MaxPktSize[7:0]
EndpointNumber[3:0]
B3[3]
Speed
MaxPktSize[9:8]
TotalBytes[7:0]
B5[7]
reserved
B5[6]
reserved
DirToken[1:0]
TotalBytes[9:8]
FunctionAddress[6:0]
B7[7:0]
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PDF描述 |
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