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參數(shù)資料
| 型號： | EP7209 |
| 廠商： | Cirrus Logic, Inc. |
| 英文描述： | Ultra-Low-Power Audio Decoder System-on-Chip |
| 中文描述： | 超低功耗音頻解碼器系統(tǒng)級芯片 |
| 文件頁數(shù)： | 95/128頁 |
| 文件大?。?/td> | 1382K |
| 代理商： | EP7209 |
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EP7209
DS453PP2
95
6.4
All characteristics are specified at V
DD
= 2.3 to 2.7 volts and V
SS
= 0 volts over an operating temperature
of 0
°
C to +70
°
C. Those characteristics marked with a # will be significantly different for 13 MHz mode
because the EXPCLK is provided as an input rather than generated internally. These timings are estimated
at present. The timing values are referenced to 1/2 V
DD
.
AC Characteristics
Symbol
Parameter
13 MHz
18/36 MHz
Units
Min
0
0
0 #
10 #
0 #
10 #
10
–
10
80
80
0
80
80
200
300
–
10
–
10
—
5
0
925
925
Max
35
45
—
—
—
50
—
10
3,475
3,475
25
3,475
3,475
6,950
10,425
20
20
33 #
—
512
1025
1025
7
528
448
80
Min
0
0
18
0
18
0
5
–
10
80
80
0
80
80
200
300
–
10
–
10
—
5
0
925
925
Max
25
35
—
—
—
50
—
10
3,475
3,475
25
3,475
3,475
6,950
10,425
20
20
5
—
512
1025
1025
7
528
448
80
t1
t2
t3
t4
t5
t6
t7
t8
t15
t16
t17
t18
t19
t20
t21
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t24
t25
t31
t32
t33
t34
t35
t36
t37
t38
t39
t40
Falling CS to data bus Hi-Z
Address change to valid write data
DATA in to falling EXPCLK setup time
DATA in to falling EXPCLK hold time
EXPRDY to falling EXPCLK setup time
Falling EXPCLK to EXPRDY hold time
Rising nMWE to data invalid hold time
Sequential data valid to falling NMWE setup time
LCD CL2 low time
LCD CL2 high time
LCD falling CL[2] to rising CL[1] delay
LCD falling CL[1] to rising CL[2]
LCD CL[1] high time
LCD falling CL[1] to falling CL[2]
LCD falling CL[1] to FRM toggle
LCD falling CL[1] to M toggle
LCD rising CL[2] to display data change
Falling EXPCLK to address valid
Data valid to falling nMWE for non sequential access only
SSICLK period (slave mode)
SSICLK high
SSICLK low
SSICLK rise/fall time
SSICLK rising to RX and/or TX frame sync
SSICLK rising edge to frame sync low
SSICLK rising edge to TX data valid
SSIRXDA data set-up time
SSIRXDA data hold time
SSITXFR and/or SSIRXFR period
The values for 36 MHz include 1 wait state, the 18 MHz values have 0 wait states.
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
kHz
ns
ns
ns
ns
ns
ns
ns
ns
ns
30
40
750
30
40
750
Table 55. AC Timing Characteristics
相關PDF資料 |
PDF描述 |
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