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參數(shù)資料
| 型號(hào)： | ENC624J600T-I/PT |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 55/168頁 |
| 文件大小： | 0K |
| 描述： | IC ETHERNET CTRLR W/SPI 64-TQFP |
| 視頻文件： | Fast 100 Mbps Ethernet PICtail Plus Overview |
| 標(biāo)準(zhǔn)包裝： | 1,200 |
| 控制器類型： | 以太網(wǎng)控制器（IEEE 802.3） |
| 接口： | SPI |
| 電源電壓： | 3 V ~ 3.6 V |
| 電流 - 電源： | 96mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-TQFP |
| 供應(yīng)商設(shè)備封裝： | 64-TQFP（10x10） |
| 包裝： | 帶卷 (TR) |
| 配用： | AC164132-ND - BOARD DAUGHTER PICTAIL ETHERNET |
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PIC18F2220/2320/4220/4320
DS39599G-page 146
2007 Microchip Technology Inc.
16.4.3
FULL-BRIDGE MODE
In Full-Bridge Output mode, four pins are used as out-
puts; however, only two outputs are active at a time. In
the Forward mode, pin RC2/CCP1/P1A is continuously
active and pin RD7/PSP7/P1D is modulated. In the
Reverse mode, RD6/PSP6/P1C pin is continuously
active and RD5/PSP5/P1B pin is modulated. These are
illustrated in Figure 16-6.
P1A, P1B, P1C and P1D outputs are multiplexed with
the PORTC<2> and PORTD<5:7> data latches. The
TRISC<2> and TRISD<5:7> bits must be cleared to
make the P1A, P1B, P1C and P1D pins output.
FIGURE 16-6:
FULL-BRIDGE PWM OUTPUT
Period
Duty Cycle
P1A(2)
P1B(2)
P1C(2)
P1D(2)
FORWARD MODE
(1)
Period
Duty Cycle
P1A(2)
P1C(2)
P1D(2)
P1B(2)
REVERSE MODE
(1)
Note 1: At this time, the TMR2 register is equal to the PR2 register.
Note 2: Output signal is shown as active-high.
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