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參數(shù)資料
| 型號： | DSP56364P |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 24位音頻數(shù)字信號處理器 |
| 文件頁數(shù)： | 31/148頁 |
| 文件大?。?/td> | 1204K |
| 代理商： | DSP56364P |
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External Memory Expansion Port (Port A)
DSP56364 Technical Data, Rev. 4
Freescale Semiconductor
3-15
Figure 3-9 SRAM Read Access
118
TA setup before RD or WR deassertion
4
0.25
×
T
C
+ 2.0
4.5
—
ns
119
TA hold after RD or WR deassertion
0
—
ns
1
All timings for 100 MHz are measured from 0.5 · Vcc to .05 · Vcc
2
WS is the number of wait states specified in the BCR.
3
Timings 100, 107 are guaranteed by design, not tested.
4
In the case of TA negation: timing 118 is relative to the deassertion edge of RD or WR were TA to remain active.
Table 3-8 SRAM Read and Write Accesses
1
(continued)
No.
Characteristics
Symbol
Expression
2
Min
Max
Unit
A0–A17
AA0–AA1
RD
WR
D0–D7
115
105
106
113
104
116
117
100
AA0468
TA
119
Data
In
118
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP56366P | 24-Bit Audio Digital Signal Processor |
| DSP56366UM | 24-Bit Audio Digital Signal Processor |
| DSP56367P | 24-Bit Audio Digital Signal Processor |
| DSP56367UM | 24-Bit Audio Digital Signal Processor |
| DSP56600 | Implementing Viterbi Decoders Using the VSL Instruction on DSP Families |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DSP56364UM | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP56364 24-Bit Digital Signal Processor User＇s Manual |
| DSP56366 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP56366 24-Bit Audio Digital Signal Processor |
| DSP56366P | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:24-Bit Audio Digital Signal Processor |
| DSP56366UM | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:24-Bit Audio Digital Signal Processor |
| DSP56367 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Optoelectronic |
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