參數資料
型號: C5NPD0-DS
英文描述: QUAD BILATERAL SWITCH FOR TRANSMISSION OR MULTIPLEXING OF ANALOG OR DIGITAL SIGNALS
中文描述: 的C - 5網絡處理器的數據資料硅修訂D0
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代理商: C5NPD0-DS
AC Timing Specifications
87
MOTOROLA GENERAL BUSINESS INFORMATION
C5NPD0-DS/D REV 04
Figure 23
BMU Timing Diagram
MDCLK
Cycle 1
Cycle 2
Cycle 3
Cycle 4
Cycle 5
M_ctl
MAn
MDn
(output)
MDn
(input)
T
mc
T
mdo
T
mco
T
mao
T
mdv
T
mds
T
mdz
T
mdh
Table 51
BMU Timing Description
SYMBOL
Tmc
Tmco
Tmao
Tmds
Tmdh
Tmdo
Tmdz
Tmdv
PARAMETER
BMU Cycle Time
BMU Ctrl Output
BMU Addr Output
BMU Data Setup
BMU Data Hold
BMU Data Output
BMU Data Clk to Tri*
BMU Data Clk to Driven*
MIN
8.0
1.2
1.2
0.5
1.0
1.2
1.8
1.4
TYP
MAX
UNIT
ns
ns
ns
ns
ns
ns
ns
ns
3.7
3.8
4.0
4.0
4.0
*
Not fully tested, values based on design/characterization.
Table 52
Signal Groups in BMU Timing Diagrams
SIGNAL GROUP
Control (M_ctl)
Address (MAn)
Data (MDn)
INCLUDED SIGNALS
MBA0, MBA1, MCASX, MRASX, MWEX, MCSX, MDQM
MA0 - MA11
MD0 - MD129, MDECC0 - MDECC8
F
n
.
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