參數(shù)資料
型號(hào)： C5NPD0-DS
英文描述： QUAD BILATERAL SWITCH FOR TRANSMISSION OR MULTIPLEXING OF ANALOG OR DIGITAL SIGNALS
中文描述： 的C - 5網(wǎng)絡(luò)處理器的數(shù)據(jù)資料硅修訂D0
文件頁(yè)數(shù)： 79/100頁(yè)
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代理商： C5NPD0-DS
AC Timing Specifications
79
MOTOROLA GENERAL BUSINESS INFORMATION
C5NPD0-DS/D REV 04
Figure 16
OC-3 Timing Diagram
Cycle 1
Cycle 2
Cycle 3
Cycle 4
Cycle 5
CPn_2
Cycle 1
Cycle 2
Cycle 3
Cycle 4
Cycle 5
CPn_3
CPn_0
CPn_1
CPn_4
CPn_5
T
c3t
T
c3r
T
c3d
T
c3i
T
c3s
T
c3h
T
c3s
T
c3h
Table 44
OC-3 Timing Description
SYMBOL
PARAMETER
MIN
TYP
MAX
UNIT
Tc3t
OC-3 Transmit Cycle Time
6.43
ns
Tc3i
OC-3 Pulse Width
2.0
ns
Tc3r
OC-3 Receive Cycle Time*
*
155.52MHz
6.0
ns
Tc3d
OC-3 Clock Duty Cycle
40
60
%
Tc3s
OC-3 Setup Time
2.0
ns
Tc3h
OC-3 Hold Time
2.5
ns
F
n
.
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PDF描述
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