參數(shù)資料
型號: PM7329
廠商: PMC-Sierra, Inc.
英文描述: ATM TRAFFIC MANAGER AND SWITCH
中文描述: ATM流量管理器和開關(guān)
文件頁數(shù): 35/232頁
文件大小: 1585K
代理商: PM7329
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁當(dāng)前第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁
PM7329 S/UNI-APEX-1K800
DATASHEET
PMC-2010141
ISSUE 2
ATM TRAFFIC MANAGER AND SWITCH
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
21
Pin Name
Type
Pin
No.
Function
LRSOP
Input
J2
Loop Receive Start of Packet .
LRSOP marks the
start of the cell on the LRDAT[15:0] bus. When
LRSOP is high, the first data word of the cell is
present on the LRDAT[15:0] stream. If the selected
device is an Any-PHY device, the LRSOP cycle will
be preceded by the LRSX cycle marking the Any-
PHY port address transfer cycle.
LRSOP considered valid only when the LRENB
signal is low. LRSOP becomes high impedance
upon sampling LRENB high or if no physical layer
device was selected for transfer.
LRSOP is sampled on the rising edge of LRCLK.
LRDAT[0]
..
LRDAT[15]
Input
J1
K2
L3
K1
L2
M4
L1
M3
M2
M1
N3
N2
P2
P3
P4
R1
Loop Receive Data.
LRDAT[15:0] carries the
transfer block words that have been read from the
physical layer device to the S/UNI-APEX-1K800
internal cell buffers.
LRDAT bus is considered valid only when the
LRENB signal was low N cycles previous. LRDAT is
expected to become high impedance N LRCLK
cycles after sampling LRENB high or upon
completion of a data block transfer. If the PHY
device is a UTOPIA device, N=1. If the PHY device
is an Any-PHY device, N=2.
All 16 bits are used in 16-bit mode. In 8 bit mode,
LRDAT[15:8] should either be tied high or low, as
only the first 8 bits LTDAT[7:0] are valid.
LRDAT[15:0] is sampled on the rising edge of
LRCLK.
相關(guān)PDF資料
PDF描述
PM7339 Quad Cell Delineation Block Device
PM7340 S/UNI INVERSE MULTIPLEXING FOR ATM, 8 LINKS
PM7340-PI SCREW,WING
PM7341 S/UNI INVERSE MULTIPLEXING FOR ATM, 84 LINKS
PM7342 32 Link Inverse Multiplexer for ATM (IMA) / UNI PHY
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PM7329-BI 制造商:PMC 制造商全稱:PMC 功能描述:ATM TRAFFIC MANAGER AND SWITCH
PM733 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC
PM7339 制造商:PMC 制造商全稱:PMC 功能描述:SATURN USER NETWORK INTERFACE CELL DELINEATION BLOCK