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參數(shù)資料
| 型號(hào)： | PLB2224 |
| 英文描述： | 24+2G Switch On a Chip with Embedded Memory |
| 中文描述： | 24第二代開關(guān)與嵌入式內(nèi)存芯片 |
| 文件頁數(shù)： | 49/219頁 |
| 文件大小： | 2975K |
| 代理商： | PLB2224 |
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GREEN
PLB 2224
Functional Description
Data Sheet
49
2002-06-03
Oversize packet
A dropped packet
ma change
collision ( in conjunction with mask_coll_led bit in switch configuration register)
late collision
Serial Mode LED
The above information is serialy shifted out, when the LED interface is configured in
serial mode
LED_row_n[0] : led_sync
LED_row_n[1] : led_load
LED_row_n[2] : led_data
LED_row_n[3] : led_clk
3.3.9
Reset and Initialisation
Setting reset_n low (for a minimum of 3 clocks or 30 ns) activates the reset and
initialization block. When in the reset state, all the internal logic is reset and all
configuration registers are set to their default values.
When the RESET_N line goes from low to high, the logic levels on the strapping pins are
registered and stored in the appropriate configuration registers and the PLB 2224 enters
a secondary reset state. During this state, the PLB 2224 initializes the data structures
such as MA Table, reset sequence for the EDRAM and Packet Buffer Link List (PBLL).
If the PLB 2224 is configured as a non-CPU system, some of the configuration registers
are read from the EPROM. Data integrity check on the EPROM data is carried out. If it
fails, the status LED (i.e., LED #3) for port #7 continues to blink indicating an EPROM
read error. Tthe port logic is disabled until the PLB 2224 successfully completes power
on sequence, is configured correctly and determines that the 10/100 and gigabit links are
OK.
3.3.9.1
Power Strapping
The LED interface pins led_row_n[3:0] and led_col[26:0] are also used as power
strapping pins to set certain operating parameters for the PLB 2224. On the rising edge
of the reset_n pulse, the logic level of led_row_n[3:0] and led_col[23:0] are sensed and
latched into the Chip Configuration Register as shown in
“Chip Configuration
Register” on Page 141
. All the LED signals have internal pullups. The power strapping
pins can be pulled-up through ~10 K resistor or pulled-down through a ~1 K ohm resistor
to set the required value.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PLBYTEBLASTERCABLE | 60MHz, Rail-to-Rail Output, 1.9nV/rtHz, 1.2mA Op Amp Family; Package: SO; No of Pins: 8; Temperature Range: -40°C to +85°C |
| PLC01-6 | 60MHz, Rail-to-Rail Output, 1.9nV/rtHz, 1.2mA Op Amp Family; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| PLC03-6 | 500mA, 200MHz xDSL Line Driver in 16-Lead SSOP Package; Package: SSOP; No of Pins: 16; Temperature Range: -40°C to +85°C |
| LCO3-6 | Direct ProTek Replacement:PLC03-6 |
| PLC16V8H35N | Dual 500mA, Differential xDSL Line Driver in 28-Lead TSSOP Package; Package: TSSOP; No of Pins: 28; Temperature Range: 0°C to +70°C |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PLB2224EV1.3 | 制造商:Rochester Electronics LLC 功能描述: |
| PLB24 | 制造商:Pentair Technical Products / Hoffman 功能描述:Lifting Bars (2) , 2400mm wide, Steel |
| P-LB24 | 制造商:Pentair Technical Products / Hoffman 功能描述:Lifting Bars (2) |
| PLB2800 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Configurable Ethernet Switch-on-a-Chip |
| PLB2S-C | 功能描述:電纜束帶 Double Loop Tie 7.6"L (193mm) Std RoHS:否 制造商:Phoenix Contact 產(chǎn)品:Cable Tie Mounts 類型:Adhesive 顏色:Black 材料:Acrylonitrile Butadiene Styrene (ABS) 長(zhǎng)度:19 mm 寬度:19 mm 抗拉強(qiáng)度: |
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