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參數(shù)資料
| 型號： | PLB2224 |
| 英文描述： | 24+2G Switch On a Chip with Embedded Memory |
| 中文描述： | 24第二代開關(guān)與嵌入式內(nèi)存芯片 |
| 文件頁數(shù)： | 166/219頁 |
| 文件大?。?/td> | 2975K |
| 代理商： | PLB2224 |
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GREEN
PLB 2224
Register Description
Data Sheet
166
2002-06-03
mem_addr[10:1]
Memory access lower address bits.
For each memory Write access, 2-bytes per access will be temporarily stored into a 16-
byte register with the offset given by mem_addr[3:1]. The real memory transfer operation
won’t start until mem_addr[3:1] stands for the last access, i.e. equal to ‘e’.
access_rdy
bit won’t be set until the receiving memory has acknowledged.
For each 16-bytes of memory Write, there are eight Write’s for this register and the value
for Bit’s[3:1] for the first write is 0. After receiving the eighth Write with mem_addr[3:0]
equal to ‘e’, the memory operation starts.
For a 16-bytes of Read, PLB 2224 issues a command to request for 16-bytes of data
from memory after receiving a Read command with mem_addr[3:1] equal to 0. CPU then
polls this register for mem_data[] until
access_rdy
is asserted. After detecting
access_rdy
, CPU reads the first two bytes. It continues to issue the Read command with
mem_addr[3:1] as a continuous offset, and then polls for
access_rdy
after which
mem_data[]
is valid. During the subsequent polling,
access_rdy
should be always ready
because all the 16-bytes of the data are ready when the command with mem_addr[3:1]
equal to 0.
For MII’s PHY access, each Read or Write command is to access 2-bytes of data. For
each Write command, the state machine starts to write mem_data[] onto the external
device. For each Read command, the state machine starts to get the data onto
mem_data[].
access_rdy
is asserted when the read or write command is completed.
For MII’s PHY register access, mem_addr[10:6] is for PHY device ID and mem_addr[5:1]
is for PHY’s internal register address.
Details on Indirect memory accesses can be found in
“Indirect Access to the
Memories” on Page 62
28:27
mem_sel
(R/W)
00
00 to select MII’s PHY.
01 – reserved.
10 – reserved.
11 for memory access. Upper address
bits are needed. Refer to memory upper
address register for them.
Reserved
26
reserved
0
25:16
mem_addr [10:1] (R/W)
X
The description of this field is given
below the table.
Write data for Write command, and Read
data for Read command.
15:0
mem_data [15:0] (R/W)
x
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