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參數(shù)資料
| 型號： | PLB2224 |
| 英文描述： | 24+2G Switch On a Chip with Embedded Memory |
| 中文描述： | 24第二代開關(guān)與嵌入式內(nèi)存芯片 |
| 文件頁數(shù)： | 111/219頁 |
| 文件大?。?/td> | 2975K |
| 代理商： | PLB2224 |
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GREEN
PLB 2224
Interface Description
Data Sheet
111
2002-06-03
6.2.2.4
Generic Interface Signals Description
Table 46
Generic Interface Signals
INTA_n
O
Interrupt A is an active low interrupt to the host. INTA_n must
be used for any single-function device requiring an interrupt
capability.
SEL_IIC = 0
SEL_PCI = 1
SEL_IIC
T_RSV1
(SEL_PCI)
I
I
Signal Name Signal
Type
I
Signal Description
PCI_CLK
GENERIC mode wait cycle select
Cycle_sel0 =0: no wait
Cycle_sel0 =1: wait delay cycle = 3 cycles = 90 ns
Reset Input (Asynchronous)
When muxed_AD = 1, AD[] is multiplexed address and databus.
When muxed_AD = 0, D[] is bidirectional databus.
Treated as ALE / AS_n for Generic Interface
When:
muxed_AD = 1, ALE is the active-high address latch enable
input for latching the multiplexed address on AD[].
muxed_AD = 0, AS_n is the active-low address strobe input for
latching the address lines on A2 thru A8.
Treated as useDS for Generic Interface
When:
useDS = 1, the active-low data strobe signal DS_n and the
read/write signal RD/WR_n are used for memory I/O control.
useDS = 0, the active-low read strobe signal RD_n and the
active-low write strobe signal WR_n are used for memory I/O
control.
Treated as DS_n for Generic Interface
DS_n is the active-low data strobe signal used when useDS = 1.
RD_n is the active-low read strobe signal when useDS = 0.
RESET_n
AD[31:0]
I
B
CBE_N[3]
I
CBE_N[2]
I
CBE_N[1]
I
Signal Name Signal
Type
Signal Description
相關(guān)PDF資料 |
PDF描述 |
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| LCO3-6 | Direct ProTek Replacement:PLC03-6 |
| PLC16V8H35N | Dual 500mA, Differential xDSL Line Driver in 28-Lead TSSOP Package; Package: TSSOP; No of Pins: 28; Temperature Range: 0°C to +70°C |
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