參數(shù)資料
型號(hào)： PEF22554E
廠商： INFINEON TECHNOLOGIES AG
元件分類： 數(shù)字傳輸電路
英文描述： DATACOM, FRAMER, PBGA160
封裝： GREEN, PLASTIC, QFP-144
文件頁數(shù)： 47/700頁
文件大?。?/td> 25742K
代理商： PEF22554E
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QuadFALC
TM
PEF 22554 E
Functional Description E1
Data Sheet
140
Rev. 1.2, 2006-01-26
4.3.5.4
Parallel Transmit CAS (E1)
The CAS information is taken from the registers XS(16:1) (XS1_E) and is transmitted on a multiframe boundary
in time slot 16. So the CAS information is controllable by the micro controller over the asynchronous, the SPI or
the SCI interface. The signaling controller inserts the bit stream on the transmit line side.
If the QuadFALC
TM is configured for no signaling, the system interface data stream passes the QuadFALCTM
undisturbed.
4.4
Framer Operating Modes (E1)
4.4.1
General (E1)
The general parameters are
The operating mode of the QuadFALC
TM is selected by programming the carrier data rate and characteristics, line
code, multiframe structure, and signaling scheme.
The QuadFALC
TM implements all of the standard framing structures for E1 or PCM 30 (CEPT, 2.048 Mbit/s)
carriers. The internal HDLC or CAS controller supports all signaling procedures including signaling frame
synchronization/synthesis and signaling alarm detection in all framing formats. The time slot assignment from the
PCM line to the system highway and vice versa is performed without any changes of numbering (TS0
TS0, …,
TS31
TS31).
Summary of supported E1 Framing Modes
Doubleframe format according to ITU-T G. 704
Multiframe format according to ITU-T G. 704
CRC4 processing according to ITU-T G. 706
Multiframe format with CRC4 to non CRC4 interworking according to ITU-T G. 706
Multiframe format with modified CRC4 to non CRC4 interworking
Multiframe format with CRC4 performance monitoring
After reset, the QuadFALC
TM is switched into doubleframe format automatically. Switching between the framing
formats is done by programming bits FMR2.RFS(1:0) and FMR3.EXTIW for the receiver and FMR1.XFS for the
transmitter.
4.4.2
Doubleframe Format (E1)
The framing structure is defined by the contents of time slot 0 (refer to Table 36).
Bit: FMR1.PMOD
:
0
PCM line bit rate
:
2.048 Mbit/s
Single frame length
:
256 bit, No. 1…256
Framing frequency
:
8 kHz
HDLC controller
:
n x 64 kbit/s, n = 1 to 32 or m x 4 kbit/s, m = 1 to 8
Organization
:
32 time slots, No. 0…31 with 8 bits each, No. 1…8
Table 36
Allocation of Bits 1 to 8 of Time Slot 0 (E1)
Bit Alternate Number Frames
1
2
3
4
5
6
7
8
Frame Containing the
Frame Alignment Signal
S
i
0
11
011
1)
Frame Alignment Signal
相關(guān)PDF資料
PDF描述
PEF22554HT DATACOM, FRAMER, PQFP144
PES12-42S-N0024
PESD3V3V4UK,132 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE
PF38F3050L0YUQ3A SPECIALTY MEMORY CIRCUIT, PBGA88
PFC04108.2UHKT 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PEF22554E-V2.1 制造商:Infineon Technologies AG 功能描述:DATACOM, FRAMER, PBGA160
PEF22554EV2.1-G 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
PEF22554EV21 制造商:Rochester Electronics LLC 功能描述:- Bulk
PEF22554EV3.1 制造商:Rochester Electronics LLC 功能描述:- Bulk
PEF22554EV3.1-G 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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