參數(shù)資料
型號(hào): MPC509
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述: 32-BIT, RISC MICROCONTROLLER, PQFP16
文件頁(yè)數(shù): 207/300頁(yè)
文件大小: 3744K
代理商: MPC509
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MPC509
USER’S MANUAL
PERIPHERAL CONTROL UNIT
Rev. 15 June 98
MOTOROLA
6-5
6.4.3 Software Watchdog Register
The software watchdog register (SWR) is a read-only register that shows the current
value of the software watchdog down counter. Writes to this register have no effect.
6.5 Interrupt Controller
Interrupts provide a mechanism for asynchronous, real-time communication between
I/O devices and the CPU. The MPC509 interrupt controller joins the simple interrupt
structure of the CPU with the complex structure of interrupt sources in the system. The
CPU has a single maskable external interrupt. A complete MPC509-based system can
have multiple interrupting modules, each with multiple interrupt sources.
The interrupt controller consolidates all the interrupt sources into a single interrupt sig-
nal to the processor. Interrupt sources include the periodic interrupt timer, external
interrupt pins, and any IMB2 peripherals.
External interrupt input pins are grouped into a general-purpose port (port Q). When
not used as interrupt inputs, any of these pins can be used for digital input or output.
Port Q operation is described in
6.6 Port Q
.
6.5.1 Interrupt Controller Operation
The following control and status registers associated with the interrupt controller indi-
cate which of 32 possible interrupt levels are pending and control which interrupt
sources are passed on to the CPU:
The pending interrupt request register (IRQPEND) contains a status bit for each
of the 32 interrupt levels.
The interrupt enable register (IRQENABLE) contains an enable bit for each of the
Table 6-3 SWCR/SWTC Bit Settings
Bit(s)
0:5
Name
Description
Reserved
Software watchdog enable
0 = Disable watchdog counter
1 = Enable watchdog counter
Software watchdog lock
0 = Enable changes to SWLK, SWE, SWTC
1 = Ignore writes to SWLK, SWE, SWTC
Software watchdog timing count. This 24-bit register contains the count for the software watch-
dog timer, which counts at system clock frequency. If this register is loaded with zero, the
maximum time-out is programmed.
6
SWE
7
SWLK
8:31
SWTC
SWR —
Software Watchdog Register
0x8007 EFC8
0
1
2
3
4
5
6
7
8
9
10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31
RESERVED
SWR
RESET:
X
X
X
X
X
X
X
X
1
1
1
1
1
1
1
1
1
1
1
1
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1
1
1
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