參數(shù)資料
型號： MPC509
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述： 32-BIT, RISC MICROCONTROLLER, PQFP16
文件頁數(shù)： 170/300頁
文件大?。?/td> 3744K
代理商： MPC509
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MOTOROLA
5-76
SYSTEM INTERFACE UNIT
Rev. 15 June 98
MPC509
USER’S MANUAL
Note that the PLL frequency is equal to the CLKOUT frequency when the RFD bits are
programmed to 0b0000 (divide by one). Note also that the value of MF0 is ignored.
However, this bit should be written to zero in case it is used in future implementations.
CAUTION
The MF bits must not be programmed to a value that requires the
VCO to operate at greater than 180 MHz. (F
VCO
= 4 x MF factor x
F
REF
.) Specifically, if the reference crystal frequency is 5 MHz, the
MF settings of X110 (times 10) and X111 (times 11) must be avoided.
The MF bits can be read and written at any time.
However, the MF bit field can be
write-protected by setting the MF lock (MPL) bit in the SCSLR.
Changing the MF bits causes the PLL to lose lock. If the loss-of-lock reset enable bit
(LOLRE) is set, the loss-of-lock condition causes the clock module to signal a reset
condition to the reset controller.
The reset controller may wait for the PLL to lock before
negating reset. Thus, the PLL can still be out of lock when RESETOUT is negated.
After changing the MF bits, software should monitor the system PLL lock status
(SPLS) bit in the SCSLR to determine lock status.
The RFD bits should always be written to a value of 0x1 or greater before changing
the MF bits to ensure the system frequency does not exceed the system’s design mar-
gin, since the VCO overshoots in frequency as it tries to compensate for the change
in frequency. For example, to change from the default system frequency to 16 MHz,
write the RFD bits to 0x1, then write the MF bits to 0x0. After the PLL locks, write the
RFD bits to 0x0.
When the PLL is operating in one-to-one mode, the multiplication factor is set to one
and MF is ignored.
Figure 5-27
shows how the PLL uses the MF bits to multiply the input crystal fre-
quency. The output of the VCO is divided down to generate the feedback signal to the
phase comparator. The MF bits control the value of the divider in the PLL feedback
loop.
The phase comparator determines the phase shift between the feedback signal
Table 5-34 Multiplication Factor Bits
MF Field (Binary)
Multiplication Factor
PLL Frequency
(with 4-MHz Reference)
16 MHz
20 MHz
24 MHz
28 MHz
32 MHz
36 MHz
40 MHz
44 MHz
x000
x001
x010
x011
x100
x101
x110
x111
4
5
6
7
8
9
10
11
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MPC509AU 功能描述:多路器開關 IC 4-Ch Diff-Input Analog Mult RoHS:否 制造商:Texas Instruments 通道數(shù)量:1 開關數(shù)量:4 開啟電阻（最大值）:7 Ohms 開啟時間（最大值）: 關閉時間（最大值）: 傳播延遲時間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:UQFN-16
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