參數(shù)資料
型號(hào)： M32186F8VFP
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144
文件頁(yè)數(shù)： 765/1032頁(yè)
文件大?。?/td> 5750K
代理商： M32186F8VFP
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DIRECT RAM INTERFACE (DRI)
14
14-10
32185/32186 Group Hardware Manual
Rev.1.10 REJ09B0235-0110 May 15, 07
DEC Interrupt Request Status Register (DRIDECIST)
<Address: H'0080 2002>
123456
b7
b0
DEC0IS
DEC1IS
DEC2IS
DEC3IS
DEC4IS
00000
0
<Upon exiting reset: H'00>
b
Bit Name
Function
R
W
0
DEC0IS (DEC0 interrupt request stabus bit)
0: Interrupt not requested
R(Note 1)
1
DEC1IS (DEC1 interrupt request stabus bit)
1: Interrupt requested
2
DEC2IS (DEC2 interrupt request stabus bit)
3
DEC3IS (DEC3 interrupt request stabus bit)
4
DEC4IS (DEC4 interrupt request stabus bit)
5–7
No function assigned. Fix to "0."
00
Note 1: Only writing "0" is effective. Writing "1" has no effect, so that the bit retains the previous value.
If one of five event counters (DEC0–DEC4) included in the DRI underflows upon reaching the terminal
count, the corresponding status bit in this register is set to "1" in hardware.
Note: If the status is cleared in software at the same time it is set for an interrupt request generated,
the latter has priority, so that the status is set.
DEC Interrupt Request Enable Register (DRIDECIEN)
<Address: H'0080 2003>
9
10
11
12
13
14
b15
b8
DEC0IEN DEC1IEN DEC2IEN DEC3IEN DEC4IEN
00000
0
<Upon exiting reset: H'00>
b
Bit Name
Function
R
W
8
DEC0IEN (DEC0 interrupt request enable bit)
0: Mask (disable) interrupt request
R
W
9
DEC1IEN (DEC1 interrupt request enable bit)
1: Enable interrupt request
10
DEC2IEN (DEC2 interrupt request enable bit)
11
DEC3IEN (DEC3 interrupt request enable bit)
12
DEC4IEN (DEC4 interrupt request enable bit)
13–15
No function assigned. Fix to "0."
00
This register enables or prohibit the interrupt requests that will be generated when one of the internal event
counters underflows.
Setting each bit in this register to "1" enables the interrupt request by the corresponding event counter
underflow.
14.2 DRI Related Registers
相關(guān)PDF資料
PDF描述
M32185F4VFP 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP144
M32185F4VFP 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP144
M34283G2GP 4-BIT, MROM, 4 MHz, MICROCONTROLLER, PDSO20
M34283G2-XXXGP 4-BIT, MROM, 4 MHz, MICROCONTROLLER, PDSO20
M34502E4FP 4-BIT, OTPROM, MICROCONTROLLER, PDSO24
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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M-322 功能描述:單板計(jì)算機(jī) IND MOTHERBOARD CORE 2 DUO LGA775 ATX RoHS:否 制造商:Ampro By ADLINK 外觀尺寸:EPIC 處理器類型:Intel Atom D510 頻率:1.66 GHz 存儲(chǔ)容量:2 GB (max) 存儲(chǔ)類型:DDR2, L2 Cache 接口類型:Ethernet, PS/2, SATA, Serial, USB 工作電源電壓:5 V, 12 V 功耗:13 W 最大工作溫度:+ 70 C 尺寸:165.1 mm x 114.3 mm
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