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參數(shù)資料
| 型號(hào)： | HYB18T256324F-22 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 256-Mbit GDDR3 DRAM [600MHz] |
| 中文描述： | 256兆GDDR3顯示內(nèi)存[600MHz的] |
| 文件頁數(shù)： | 31/80頁 |
| 文件大小： | 2026K |
| 代理商： | HYB18T256324F-22 |
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HYB18T256324F–[16/20/22]
256-Mbit DDR SGRAM
Functional Description
Data Sheet
31
Rev. 1.11, 04-2005
10292004-DOXT-FS0U
3.5
Mode Register Set Command (MRS)
Figure 14
Mode Register Set Command
The mode register stores the data for controlling the
operating modes of the memory. It programs read
latency, test mode, DLL Reset and the value of the
write latency. There is no default value for the mode
register; therefore it must be written after power up to
operate the GDDR3 Graphics RAM. During a Mode
Register Set command the address inputs are sampled
and stored in the mode register.
t
MRD
must be met before any command can be issued
to the Graphics SDRAM. The Mode Register contents
can only be set or changed when the Graphics SDRAM
is in idle state.
Figure 15
Mode Register Bitmap
Note:The DLL Reset command is self-clearing
#,+
#,+
2!3
#+%
#!3
7%
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"!
$ONgT #ARE
#/$ #ODE TO BE LOADED INTO
THE REGISTER
#3
#/$
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$,,
4-
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$,,2ESET
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ALLOTHERS
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4ESTMODE
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"URST4YPE
7,
!!
!
ALLOTHERS
2&5
SEQUENTIAL
2&5
!
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HYB18T256400AFL-3 | 256 Mbi t DDR2 SDRAM |
| HYB18T256160A-3S | 256 Mbi t DDR2 SDRAM |
| HYB18T256800AFL-3 | 256 Mbi t DDR2 SDRAM |
| HYB18T256400AFL-37 | 256 Mbi t DDR2 SDRAM |
| HYB18T256800AFL-37 | 256 Mbi t DDR2 SDRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HYB18T256400AF-3.7 | 制造商:Infineon Technologies AG 功能描述:64M X 4 DDR DRAM, 0.5 ns, PBGA60 |
| HYB18T256400AF-5 | 制造商:Infineon Technologies AG 功能描述:SDRAM, DDR, 64M x 4, 60 Pin, Plastic, BGA |
| HYB18T256800AF-5 | 制造商:Infineon Technologies AG 功能描述: |
| HYB18T512161BF-25 | 制造商:Qimonda 功能描述:SDRAM, DDR, 32M x 16, 84 Pin, Plastic, BGA |
| HYB18T512400AF-5 | 制造商:Intersil Corporation 功能描述:SDRAM, DDR, 128M x 4, 60 Pin, Plastic, BGA |
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