參數(shù)資料
型號： HMT351V7BFR8C-H9
廠商： HYNIX SEMICONDUCTOR INC
元件分類： DRAM
英文描述： DDR DRAM MODULE, DMA240
封裝： ROHS COMPLIANT, DIMM-240
文件頁數(shù)： 8/61頁
文件大?。?/td> 1050K
代理商： HMT351V7BFR8C-H9
Rev. 0.1 / Feb. 2010
16
8GB, 1Gx72 Module(4Rank of x8) - page2
D0-D35
VDD
VTT
VDDSPD
D0-D35
VREFDQ
Serial PD
VREFCA
VSS
D0-D35
VDDSPD
EVENT
SCL
SDA
SA0
SPD with
Integrated
TS
SA1
SA2
VSS
VDDSPD
EVENT
SCL
SDA
SA0
SA1
SA2
VSS
Plan to use SPD with Integrated TS of Class B and
might be changed on customer’s requests. For more
details of SPD and Thermal sensor, please contact
local Hynix sales representative
VSS
R
ASA_n
RC
AS
A_
n
RS0_n
RWE
A
_n
PC
K
0
A_t
PC
K0
A_
c
RC
K
E
0
A
RO
D
T
0
A
R
A
[N:0]A
Vtt
/RBA[N:0]A
DQ[39:32]
DQS4_t
DQS4_c
DM4/TDQS13_t
TDQS13_c
DQS
TDQS
D13
DQ [7:0]
ZQ
RAS_n
CA
S
_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N
:O
]/B
A[
N
:0
]
RS1_n
RC
K
E
1
A
VD
D
DQS
TDQS
D4
DQ [7:0]
ZQ
RAS_n
CA
S
_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N
:O
]/B
A[
N
:0
]
RS2_n
PC
K
1
A_t
PC
K1
A_
c
RO
D
T
1
A
DQS
TDQS
D31
DQ [7:0]
ZQ
RAS_n
CA
S
_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N
:O
]/B
A[
N
:0
]
RS3_n
VD
D
DQS
TDQS
D22
DQ [7:0]
ZQ
RAS_n
CA
S
_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N
:O
]/B
A[
N
:0
]
VSS
DQ[47:40]
DQS5_t
DQS5_c
DM5/TDQS14_t
TDQS14_c
DQS
TDQS
D14
DQ [7:0]
ZQ
RAS_n
CA
S_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N:
O]/
B
A[
N:
0
]
DQS
TDQS
D5
DQ [7:0]
ZQ
RAS_n
CA
S_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N:
O]/
B
A[
N:
0
]
DQS
TDQS
D32
DQ [7:0]
ZQ
RAS_n
CA
S_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N:
O]/
B
A[
N:
0
]
DQS
TDQS
D23
DQ [7:0]
ZQ
RAS_n
CA
S_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N:
O]/
B
A[
N:
0
]
VSS
DQ[55:48]
DQS6_t
DQS6_c
DM6/TDQS15_t
TDQS15_c
DQS
TDQS
D15
DQ [7:0]
ZQ
RAS
_
n
CAS
_
n
CS
_
n
WE_
n
CK_
t
CK_
c
CKE
OD
T
A[N:
O]
/B
A[N:
0
]
DQS
TDQS
D6
DQ [7:0]
ZQ
RAS
_
n
CAS
_
n
CS
_
n
WE_
n
CK_
t
CK_
c
CKE
OD
T
A[N:
O]
/B
A[N:
0
]
DQS
TDQS
D33
DQ [7:0]
ZQ
RAS
_
n
CAS
_
n
CS
_
n
WE_
n
CK_
t
CK_
c
CKE
OD
T
A[N:
O]
/B
A[N:
0
]
DQS
TDQS
D24
DQ [7:0]
ZQ
RAS
_
n
CAS
_
n
CS
_
n
WE_
n
CK_
t
CK_
c
CKE
OD
T
A[N:
O]
/B
A[N:
0
]
VSS
DQ[63:56]
DQS7_t
DQS7_c
DM7/TDQS16_t
TDQS16_c
DQS
TDQS
D16
DQ [7:0]
ZQ
RAS_n
CAS
_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N
:O
]/B
A[
N
:0
]
DQS
TDQS
D7
DQ [7:0]
ZQ
RAS_n
CAS
_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N
:O
]/B
A[
N
:0
]
DQS
TDQS
D34
DQ [7:0]
ZQ
RAS_n
CAS
_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N
:O
]/B
A[
N
:0
]
DQS
TDQS
D25
DQ [7:0]
ZQ
RAS_n
CAS
_
n
CS
_
n
WE_
n
CK
_
t
CK
_
c
CK
E
OD
T
A[
N
:O
]/B
A[
N
:0
]
VSS
Note:
1. DQ-to-I/O wiring may be changed within a nibble.
2. Unless otherwise noted, resistor values are 15
%.
3. See the wiring diagrams for all resistors associated with the com-
mand, address and control bus.
4. ZQ resistors are 240
%. For all other resistor values refer to the
appropriate wiring diagram.
±
±
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