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參數(shù)資料
| 型號： | FMMT560A |
| 文件頁數(shù)： | 237/247頁 |
| 文件大小： | 2493K |
| 代理商： | FMMT560A |
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PRODUCT SPECIFICATION
FMS2701
14
P
INT Processing
INT is a hardware interrupt output. INT operation is con-
trolled by the Configuration Register bits: INT_EN and
INT_CLR bits, which enable and clear the open drain INT
output. Subject to the setting of the Interrupt Mask Register,
INT =L, if any bit in the Interrupt Register is active. Other-
wise INT = Z, open drain. Figure 9 depicts the logical flow
of the interrupt sources to the INT output.
Figure 9. INT Output Structure
Interrupt
Status
Register
Interrupt
Status
Register
Interrupt
Status
Register
Mirror
THERM
INT
ITHERM
ATV, RTV
ITHERM
XTHERM
Mask
Gating
INT
Interrupt
Mask
Register
Interrupt
OR-gate
GPI, THERM,
RMT_FAULT
Configuration
Register
Interrupt
Control
INT_EN
INT_CLR
SOFT_RST
Interrupt
Sources
INT_RST
With Configuration Register bits INT_EN = 1 and INT_CLR
= 0, output pin INT = L, if any of the following bits are set in
the Interrupt Register:
1.
ATV: An ambient temperature limit is violated indicating
that the on-chip temperature falls outside the boundaries
established by TALO
7-0
and TAHI
7-0
.
2.
GPI: General Purpose Input, GPI is asserted. Polarity
of the GPI pin is determined by the setting of the
GPI_INVT bit in the Configuration Register.
3.
RTV: A remote thermal diode temperature limit is vio-
lated, indicating that the temperature falls outside the
boundaries established by TRLO
7-0
and TRHI
7-0
.
4.
THERM: Temperature exceeds an selected automatic
trip point (PTA
7-0
, PTR
7-0
, FTA
7-0
, or FTR
7-0
) causing
output THERM = L or the THERM input = L even if the
THERM bit in the Interrupt Register is masked.
5.
RMT_FAULT: Remote diode is either open or short circuit.
Output pin INT = Z, clearing the interrupt output, if any of
the following events occur:
1.
Interrupt Status Register is read, causing this register to
be cleared to the default state.
2.
Configuration Register bit INT_CLR = 1, which is the
default condition following an internal reset.
3.
Configuration Register bit INT_EN = 0, which is the
default condition following an internal reset.
Status of the INT_CLR and INT_EN bits does not impact the
contents of the Interrupt Status or the Interrupt Status Mirror
Registers. Reading the Interrupt Status Registers clears only
that register. Reading the Interrupt Status Mirror Register,
clears only that register.
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PDF描述 |
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