
Contents
vii
21918B/0—October 1999
AMD-K6
-
III
Processor Data Sheet
7.13
A20M# Masking of Cache Accesses . . . . . . . . . . . . . . . . . . . 202
8
Write Merge Buffer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203
8.1
8.2
EWBE Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203
Memory Type Range Registers . . . . . . . . . . . . . . . . . . . . . . . 205
UC/WC Cacheability Control Register (UWCCR) . . . . . . . . 205
9
Floating-Point and Multimedia Execution Units . . . . . . . . . 209
9.1
Floating-Point Execution Unit . . . . . . . . . . . . . . . . . . . . . . . 209
Handling Floating-Point Exceptions . . . . . . . . . . . . . . . . . . . 209
External Logic Support of Floating-Point Exceptions. . . . . 209
Multimedia and 3DNow! Execution Units . . . . . . . . . . . . 211
Floating-Point and MMX/3DNow!
Instruction Compatibility . . . . . . . . . . . . . . . . . . . . . . . . . . . 211
Registers. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .211
Exceptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211
FERR# and IGNNE# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211
9.2
9.3
10
System Management Mode (SMM) . . . . . . . . . . . . . . . . . . . . 213
10.1
10.2
10.3
10.4
10.5
10.6
10.7
10.8
10.9
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .213
SMM Operating Mode and Default Register Values . . . . . 213
SMM State-Save Area . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 216
SMM Revision Identifier . . . . . . . . . . . . . . . . . . . . . . . . . . . . 218
SMM Base Address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 219
Halt Restart Slot . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 219
I/O Trap Dword . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 220
I/O Trap Restart Slot . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 221
Exceptions, Interrupts, and Debug in SMM . . . . . . . . . . . . 222
11
Test and Debug . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 223
11.1
11.2
11.3
Built-In Self-Test (BIST) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 223
Tri-State Test Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 224
Boundary-Scan Test Access Port (TAP) . . . . . . . . . . . . . . . . 225
Test Access Port. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 225
TAP Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 225
TAP Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 226
TAP Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .231
TAP Controller State Machine. . . . . . . . . . . . . . . . . . . . . . . . 232
Cache Inhibit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 235
Purpose. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 235
L2 Cache and Tag Array Testing . . . . . . . . . . . . . . . . . . . . . 237
Level-2 Cache Array Access Register (L2AAR) . . . . . . . . . .237
Debug . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 241
Debug Registers. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 241
11.4
11.5
11.6