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參數資料
| 型號： | AMD-K6-III |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 32-Bit Microprocessor Advanced RISC86 Superscalar Microarchitecture and 3D Technology(32位微處理器帶3D技術和高級的RISC86超標量微體系結構) |
| 中文描述： | 32位微處理器高級RISC86超標微體系結構和三維技術（32位微處理器帶三維技術和高級的RISC86超標量微體系結構） |
| 文件頁數： | 154/326頁 |
| 文件大?。?/td> | 4683K |
| 代理商： | AMD-K6-III |
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136
Bus Cycles
Chapter 5
AMD-K6
-
III
Processor Data Sheet
21918B/0—October 1999
Burst Reads and
Pipelined Burst Reads
Figure 58 shows normal burst read cycles and a pipelined burst
read cycle. The AMD-K6-III processor drives CACHE# and
ADS# together to specify that the current bus cycle is a burst
cycle. If the processor samples KEN# asserted with the first
BRDY#, it performs burst transfers. During the burst transfers,
the system logic must ignore BE[7:0]# and must return all eight
bytes beginning at the starting address the processor asserts on
A[31:3]. Depending on the starting address, the system logic
must determine the successive quadword addresses (A[4:3]) for
each transfer in a burst, as shown in Table 25. The processor
expects the second, third, and fourth quadwords to occur in the
sequences shown in Table 25.
In Figure 58, the processor drives CACHE# throughout all burst
read cycles. In the first burst read cycle, the processor drives
ADS# and CACHE#, then samples BRDY# on every clock edge
starting with the clock edge after the clock edge that negates
ADS#. The processor samples KEN# asserted on the clock edge
on which the first BRDY# is sampled asserted, executes a
32-byte burst read cycle, and expects a total of four BRDY#
signals. An ideal no-wait state access is shown in Figure 58,
whereas most system logic solutions add wait states between
the transfers.
The second burst read cycle illustrates a similar sequence, but
the processor samples NA# asserted on the same clock edge
that the first BRDY# is sampled asserted. NA# assertion
indicates the system logic is requesting the processor to output
the next address early (also known as a pipeline transfer
request). Without waiting for the current cycle to complete, the
processor drives ADS# and related signals for the next burst
cycle. Pipelining can reduce processor cycle-to-cycle idle times.
Table 25. A[4:3] Address-Generation Sequence During Bursts
Address Driven By
Processor on A[4:3]
A[4:3] Addresses of Subsequent
Quadwords* Generated By System Logic
Quadword 1
00b
01b
10b
11b
Quadword 2
01b
00b
11b
10b
Quadword 3
10b
11b
00b
01b
Quadword 4
11b
10b
01b
00b
Note:
*
quadword = 8 bytes
相關PDF資料 |
PDF描述 |
|---|---|
| AMD-K6 | Circular Connector; No. of Contacts:5; Series:MS27497; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:14; Circular Contact Gender:Pin; Circular Shell Style:Wall Mount Receptacle; Insert Arrangement:14-5 RoHS Compliant: No |
| AMD27C64-150PI | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
| AMD27C64 | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
| AMD27C64-120DC | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
| AMD27C64-120DCB | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
相關代理商/技術參數 |
參數描述 |
|---|---|
| AMD-K6-III/400AFR | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
| AMD-K6-III/400AHX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
| AMD-K6-III/450AFX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
| AMD-K6-III/450AHX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
| AMD-K6-III+ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Mobile AMD-K6?-III+ Processor Data Sheet |
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