參數(shù)資料
型號： AMD-K6-III
廠商： Advanced Micro Devices, Inc.
英文描述： 32-Bit Microprocessor Advanced RISC86 Superscalar Microarchitecture and 3D Technology(32位微處理器帶3D技術(shù)和高級的RISC86超標量微體系結(jié)構(gòu))
中文描述： 32位微處理器高級RISC86超標微體系結(jié)構(gòu)和三維技術(shù)（32位微處理器帶三維技術(shù)和高級的RISC86超標量微體系結(jié)構(gòu)）
文件頁數(shù)： 322/326頁
文件大?。?/td> 4683K
代理商： AMD-K6-III
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304
Index
AMD-K6
-
III
Processor Data Sheet
21918B/0—October 1999
01h . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 247
03h . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 247
10h . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 209
exceptions and . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53
INTR. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
IRQ13. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210
NMI. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
INTR. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .108
,
250
INV . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
Invalidation Request . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
INVD Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199
K
KEN# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109
L
L1 Cache1
,
9
–
10
,
38
,
138
,
142
,
148
,
152
,
164
,
179
,
188
–
189
,
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 192
,
197
,
202
L2 Cache . 1
,
3
–
4
,
9
–
10
,
39
,
42
–
43
,
103
–
104
,
123
,
126
,
138
,
142
,
148
,
152
,
164
,
179
–
183
,
185
–
189
,
192
,
194
–
195
,
. . . . . . . . . . . . . . . . . . . . . 197
–
202
,
223
,
235
,
237
–
240
L2AAR . . . . . . . . . . . . . . . . . . . . . . . 37
,
42
,
186
,
223
,
237
–
240
L3 Cache . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1
,
3
,
235
–
236
Limit, Write Allocate . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 190
Line Fills, Cache- . . . . . . . . . . . . . . . . . . . . . . . . .186
–
187
,
237
LOCK# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110
Locked
cycles . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 158
operation with BOFF# intervention . . . . . . . . . . . . . . . . 160
operation, basic. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 158
Logic
branch . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
branch-prediction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
–
18
external support of floating-point exceptions . . . . . . . . 209
M
M/IO# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 111
Machine Check Exception . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Maskable Interrupt. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
MCAR. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .37
,
176
MCTR. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .37
–
38
,
176
Memory
or I/O . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 111
read and write, misaligned single-transfer . . . . . . . . . . 134
read and write, single-transfer . . . . . . . . . . . . . . . . . . . . 132
reads and writes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132
type range register (MTRR) . . . . . . . . . . . . . . . . . . .41
,
205
MESI. . . . . . . . . . . . . . . . . . . . . . . . . . .1
,
9
,
142
,
146
,
181
,
202
bit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
,
181
,
183
states in the data cache . . . . . . . . . . . . . . . . . . . . . . . . . . 181
Microarchitecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2
enhanced RISC86 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6
overview. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
Misaligned
I/O read and write. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141
single-transfer memory read and write . . . . . . . . . . . . . 134
MMX Technology . . . . . . . . . . . .13
–
17
,
21
,
54
,
116
,
173
,
177
exceptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211
instruction compatibility, floating-point and. . . . . . . . . 211
instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .77
,
212
register operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
Mode, Tri-State Test . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 224
Model-Specific Registers (MSR) . . . . . . . . . . . . . . . . . . . . . 37
MSR. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
MTRR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
,
205
Multimedia
execution unit . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
–
17
,
211
functional unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
N
NA# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
Negated. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
Next Address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
NMI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
,
250
No-Connect Pins. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116
,
257
Non-Maskable Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
Non-Pipelined. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 133
O
Operating Ranges . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 259
Operation, Cache . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 182
Organization, Cache. . . . . . . . . . . . . . . . . . . . . . . . . . . 179
,
203
Output Delay Timings
for 100-MHz bus operation . . . . . . . . . . . . . . . . . . . . . . . 270
for 66-MHz bus operation . . . . . . . . . . . . . . . . . . . . . . . . 274
Output Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 174
P
Package
specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 297
thermal specifications. . . . . . . . . . . . . . . . . . . . . . . . . . . 285
Page
cache disable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 113
directory entry (PDE) . . . . . . . . . . . . . . . . . . . . . 48
–
49
,
183
table entry (PTE). . . . . . . . . . . . . . . . . . . . . . . . . 48
,
50
,
183
writethrough. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115
Paging . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
Parity. . . . . . . . . . . . . . . . . . . . . . . . . . 84
,
89
,
91
,
99
,
114
,
132
bit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89
,
99
,
114
check . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89
–
90
,
99
,
114
error . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .90
,
114
,
148
,
226
flags. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
PCD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 113
,
183
,
192
PCHK# . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 114
PFIR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
–
42
,
176
Pin
connection requirements . . . . . . . . . . . . . . . . . . . . . . . . 257
description diagram. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 293
designations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 295
Pipeline. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
,
130
–
131
,
136
control. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
register X and Y. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
six-stage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6
,
8
Pipelined. . . . . . . . . .9
,
16
,
112
,
131
,
136
–
137
,
154
,
179
,
194
burst reads . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 136
cycles. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
,
87
,
98
design . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
Pointer, Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
Power
相關(guān)PDF資料
PDF描述
AMD-K6 Circular Connector; No. of Contacts:5; Series:MS27497; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:14; Circular Contact Gender:Pin; Circular Shell Style:Wall Mount Receptacle; Insert Arrangement:14-5 RoHS Compliant: No
AMD27C64-150PI 64 Kilobit (8,192 x 8-Bit) CMOS EPROM
AMD27C64 64 Kilobit (8,192 x 8-Bit) CMOS EPROM
AMD27C64-120DC 64 Kilobit (8,192 x 8-Bit) CMOS EPROM
AMD27C64-120DCB 64 Kilobit (8,192 x 8-Bit) CMOS EPROM
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
AMD-K6-III/400AFR 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor
AMD-K6-III/400AHX 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor
AMD-K6-III/450AFX 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor
AMD-K6-III/450AHX 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor
AMD-K6-III+ 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Mobile AMD-K6?-III+ Processor Data Sheet
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