- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄366557 > AMD-K6-III (Advanced Micro Devices, Inc.) 32-Bit Microprocessor Advanced RISC86 Superscalar Microarchitecture and 3D Technology(32位微處理器帶3D技術(shù)和高級(jí)的RISC86超標(biāo)量微體系結(jié)構(gòu)) PDF資料下載
參數(shù)資料
| 型號(hào)： | AMD-K6-III |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 32-Bit Microprocessor Advanced RISC86 Superscalar Microarchitecture and 3D Technology(32位微處理器帶3D技術(shù)和高級(jí)的RISC86超標(biāo)量微體系結(jié)構(gòu)) |
| 中文描述： | 32位微處理器高級(jí)RISC86超標(biāo)微體系結(jié)構(gòu)和三維技術(shù)（32位微處理器帶三維技術(shù)和高級(jí)的RISC86超標(biāo)量微體系結(jié)構(gòu)） |
| 文件頁(yè)數(shù)： | 122/326頁(yè) |
| 文件大?。?/td> | 4683K |
| 代理商： | AMD-K6-III |
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104
Signal Descriptions
Chapter 4
AMD-K6
-
III
Processor Data Sheet
21918B/0—October 1999
4.24
HIT# (Inquire Cycle Hit)
Output
Summary
The processor asserts HIT# during an inquire cycle to indicate
that the cache line is valid within the processor’s L1 and/or L2
caches (also known as a cache
hit). The cache line can be in the
modified, exclusive, or shared state.
Driven
HIT# is always driven—except in the Tri-State Test mode—and
only changes state the clock edge after the clock edge on which
EADS# is sampled asserted. It is driven in the same state until
the next inquire cycle.
4.25
HITM# (Inquire Cycle Hit To Modified Line)
Output
Summary
The processor asserts HITM# during an inquire cycle to indicate
that the cache line exists in the processor’s L1 data cache or L2
cache in the modified state. The processor performs a writeback
cycle as a result of this cache hit. If an inquire cycle hits a cache
line that is currently being written back, the processor asserts
HITM# but does not execute another writeback cycle. The
system logic must not expect the processor to assert ADS# each
time HITM# is asserted.
Driven
HITM# is always driven—except in the Tri-State Test mode—
and, in particular, is driven to represent the result of an inquire
cycle the clock edge after the clock edge on which EADS# is
sampled asserted. If HITM# is negated in response to the
inquire address, it remains negated until the next inquire cycle.
If HITM# is asserted in response to the inquire address, it
remains asserted throughout the writeback cycle and is negated
one clock edge after the last BRDY# of the writeback is sampled
asserted.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AMD-K6 | Circular Connector; No. of Contacts:5; Series:MS27497; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:14; Circular Contact Gender:Pin; Circular Shell Style:Wall Mount Receptacle; Insert Arrangement:14-5 RoHS Compliant: No |
| AMD27C64-150PI | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
| AMD27C64 | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
| AMD27C64-120DC | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
| AMD27C64-120DCB | 64 Kilobit (8,192 x 8-Bit) CMOS EPROM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| AMD-K6-III/450AHX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
| AMD-K6-III+ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Mobile AMD-K6?-III+ Processor Data Sheet |
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