參數(shù)資料
型號： ADSP-2191
廠商： Analog Devices, Inc.
元件分類： 數(shù)字信號處理
英文描述： DSP Microcomputer
中文描述： DSP微機
文件頁數(shù)： 38/52頁
文件大?。?/td> 1873K
代理商： ADSP-2191
ADSP-2191M
–38–
REV. 0
Serial Peripheral Interface (SPI) Port—Slave Timing
Table 21
and
Figure 22
describe SPI port slave operations.
Table 21. Serial Peripheral Interface (SPI) Port—Slave Timing
Parameter
Min
Max
Unit
Switching Characteristics
t
DSOE
t
DSDHI
t
DDSPID
t
HDSPID
SPISS
Assertion to Data Out Active
SPISS
Deassertion to Data High Impedance
SCLK Edge to Data Out Valid (Data Out Delay)
SCLK Edge to Data Out Invalid (Data Out Hold)
0
0
0
0
8
10
10
10
ns
ns
ns
ns
Timing Requirements
t
SPICHS
t
SPICLS
t
SPICLK
t
HDS
t
SPITDS
t
SDSCI
t
SSPID
t
HSPID
Serial Clock High Period
Serial Clock Low Period
Serial Clock Period
Last SPICLK Edge to
SPISS
Not Asserted
Sequential Transfer Delay
SPISS
Assertion to First SPICLK Edge
Data Input Valid to SCLK Edge (Data Input Setup)
SCLK Sampling Edge to Data Input Invalid (Data In Hold)
2t
HCLK
2t
HCLK
4t
HCLK
2t
HCLK
2t
HCLK
+4
2t
HCLK
1.6
2.4
ns
ns
ns
ns
ns
ns
ns
ns
Figure 22. Serial Peripheral Interface (SPI) Port—Slave Timing
t
HSPID
t
DDSPID
t
DSDHI
LSB
MSB
MSB
VALID
t
HSPID
t
DSOE
t
DDSPID
t
HDSPID
MISO
(OUTPUT)
MOSI
(INPUT)
t
SSPID
SPISS
(INPUT)
SCLK
(CPOL = 0)
(INPUT)
SCLK
(CPOL = 1)
(INPUT)
t
SDSCI
t
SPICHS
t
SPICLS
t
SPICLS
t
SPICLK
t
HDS
t
SPICHS
t
SSPID
t
HSPID
t
DSDHI
LSB
VALID
MSB
MSB
VALID
t
DSOE
t
DDSPID
MISO
(OUTPUT)
MOSI
(INPUT)
t
SSPID
LSB
VALID
LSB
t
SPITDS
CPHA = 0
CPHA = 1
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