參數(shù)資料
型號： ADSP-2191
廠商： Analog Devices, Inc.
元件分類： 數(shù)字信號處理
英文描述： DSP Microcomputer
中文描述： DSP微機
文件頁數(shù)： 25/52頁
文件大小： 1873K
代理商： ADSP-2191
–25–
REV. 0
ADSP-2191M
External Port Bus Request and Grant Cycle Timing
Table 14
and
Figure 13
describe external port bus request and bus grant operations.
Table 14. External Port Bus Request and Grant Cycle Timing
Parameter
1, 2
1
t
HCLK
is the peripheral clock period.
2
These are timing parameters that are based on worst-case operating conditions.
Min
Max
Unit
Switching Characteristics
t
SD
t
SE
t
DBG
t
EBG
t
DBH
t
EBH
CLKOUT High to
xMS
, Address, and
RD
/
WR
Disable
CLKOUT Low to
xMS
, Address, and
RD
/
WR
Enable
CLKOUT High to
BG
Asserted Setup
CLKOUT High to
BG
Deasserted Hold Time
CLKOUT High to
BGH
Asserted Setup
CLKOUT High to
BGH
Deasserted Hold Time
0.5t
HCLK
+1
4
4
4
4
4
ns
ns
ns
ns
ns
ns
0
0
0
0
0
Timing Requirements
t
BS
t
BH
BR
Asserted to CLKOUT High Setup
CLKOUT High to
BR
Deasserted Hold Time
4.6
0
ns
ns
Figure 13. External Port Bus Request and Grant Cycle Timing
t
BH
BR
A21–0
MS3–0
IOMS
BMS
CLKOUT
t
BS
t
SD
t
SD
t
SD
t
DBG
t
DBH
t
SE
t
SE
t
SE
t
EBG
t
EBH
BG
WR
RD
BGH
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PDF描述
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