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參數(shù)資料
| 型號： | AD9548BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 89/112頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 88LFCSP |
| 產(chǎn)品變化通告： | AD9548 Mask Change 20/Oct/2010 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 時(shí)鐘/頻率發(fā)生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum |
| 輸入： | CMOS，LVDS，LVPECL |
| 輸出： | CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:1 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 750kHz |
| 電源電壓： | 1.71 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 88-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 88-LFCSP-VQ（12x12） |
| 包裝： | 托盤 |
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AD9548
Data Sheet
Rev. E | Page 78 of 112
Table 68. Distribution Synchronization
Address
Bits
Bit Name
Description
0x0402
[7:6]
Unused
[5:4]
Sync source
Select the sync source for the clock distribution output channels.
00 (default) = direct.
01 = active reference.
10 = DPLL feedback edge.
11 = reserved.
[3]
OUT3 sync mask
Mask the synchronous reset to the OUT3 divider.
0 (default) = unmasked
1 = masked.
[2]
OUT2 sync mask
Mask the synchronous reset to the OUT2 divider.
0 (default) = unmasked.
1 = masked.
[1]
OUT1 sync mask
Mask the synchronous reset to the OUT1 divider.
0 (default) = unmasked.
1 = masked.
[0]
OUT0 sync mask
Mask the synchronous reset to the OUT0 divider.
0 (default) = unmasked.
1 = masked.
Table 69. Automatic Synchronization
Address
Bits
Bit Name
Description
0x0403
[7:2]
Unused
[1:0]
Automatic sync mode
Autosync mode
00 (default) = disabled
01 = sync on DPLL frequency lock
10 = sync on DPLL phase lock
11 = reserved
Table 70. Distribution Channel Modes
Address
Bits
Bit Name
Description
0x0404
[7:6]
Unused
[5]
OUT0 CMOS phase
invert
When the output mode is CMOS, the bit inverts the relative phase between the two
CMOS output pins. Otherwise, this bit is nonfunctional.
0 (default) = not inverted.
1 = inverted.
[4]
OUT0 polarity invert
Invert the polarity of OUT0.
0 (default) = not inverted.
1 = inverted.
[3]
OUT0 drive strength
OUT0 output drive capability control.
0 (default) = CMOS: low drive strength; LVDS: 3.5 mA nominal.
1 = CMOS: normal drive strength; LVDS: 7 mA nominal.
[2:0]
OUT0 mode
OUT0 operating mode select.
000 = CMOS (both pins)
001 = CMOS (positive pin), tristate (negative pin).
010 = tristate (positive pin), CMOS (negative pin).
011 (default) = tristate (both pins).
100 = LVDS.
101 = LVPECL.
110 = reserved.
111 = reserved.
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PDF描述 |
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