參數(shù)資料
型號： 62371AB
廠商： Intel Corp.
英文描述： multi-function PCI device(多功能PCI設(shè)備)
中文描述： 多功能PCI設(shè)備（多功能的PCI設(shè)備）
文件頁數(shù)： 77/284頁
文件大小： 1042K
代理商： 62371AB
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E
4.2.2.6.
82371AB (PIIX4)
77
4/9/97 2:23 PM PIIX4aDS
INTEL CONFIDENTIAL
(until publication date)
PRELIMINARY
OCW1—Operational Control Word 1 Register (IO)
I/O Address:
Default Value:
Attribute:
INT CNTRL-1—021h; INT CNTRL-2—0A1h
00h
Read/Write
OCW1 sets and clears the mask bits in the Interrupt Mask Register (IMR). Each interrupt request line may be
selectively masked or unmasked any time after initialization. The IMR stores the interrupt line mask bits. The
IMR operates on the IRR. Masking of a higher priority input does not affect the interrupt request lines of lower
priority. Unlike status reads of the ISR and IRR, for reading the IMR, no OCW3 is needed. The output data bus
contains the IMR when an I/O read is active and the I/O address is 021h or 0A1h (OCW1). All writes to OCW1
must occur following the ICW1-ICW4 initialization sequence, since the same I/O ports are used for OCW1,
ICW2, ICW3 and ICW4.
Bit
Description
7:0
Interrupt Request Mask (Mask [7:0])
. When a 1 is written to any bit in this register, the
corresponding IRQx line is masked. For example, if bit 4 is set to a 1, then IRQ4 is masked. Interrupt
requests on IRQ4 do not set channel 4’s interrupt request register (IRR) bit as long as
the channel is masked. When a 0 is written to any bit in this register, the corresponding IRQx
is unmasked. Note that masking IRQ2 on CNTRL-1 also masks the interrupt requests from CNTRL-
2, which is physically cascaded to IRQ2.
4.2.2.7.
OCW2—Operational Control Word 2 Register (IO)
I/O Address:
Default Value:
Attribute:
INT CNTRL-1—020h; INT CNTRL-2—0A0h
Bit[4:0]=undefined; Bit[7:5]=001
Write Only
OCW2 controls both the Rotate Mode and the End of Interrupt Mode. Following a CPURST or ICW initialization,
the controller enters the fully nested mode of operation. Both rotation mode and specific EOI mode are disabled
following initialization.
Bit
Description
7:5
Rotate and EOI Codes.
(R, SL, EOI). These three bits control the Rotate and End of Interrupt
modes and combinations of the two. A chart of these combinations is listed above under the bit
definition.
Bits[7:5] Function
001
011
101
100
Bits[7:5]
000
111
110
010
Function
Rotate in Auto EOI Mode (Clear)
*Rotate on Specific EOI Cmd
*Set Priority Cmd
No Operation
Non-specific EOI Cmd
Specific EOI Cmd
Rotate on Non-Spec EOI Cmd
Rotate in Auto EOI Mode (Set)
* L0-L2 Are Used
4:3
OCW2 Select.
Must be programmed to 00 selecting OCW2.
相關(guān)PDF資料
PDF描述
6259 CONNECTOR ACCESSORY
6273 8-BIT LATCHED DMOS POWER DRIVER
6275 8-BIT SERIAL-INPUT, CONSTANTCURRENT LATCHED LED DRIVER
6276 16-BIT SERIAL-INPUT, CONSTANTCURRENT LATCHED LED DRIVER
6277 8-BIT SERIAL-INPUT, CONSTANTCURRENT LATCHED LED DRIVER
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