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參數(shù)資料
| 型號： | 62371AB |
| 廠商： | Intel Corp. |
| 英文描述： | multi-function PCI device(多功能PCI設(shè)備) |
| 中文描述： | 多功能PCI設(shè)備（多功能的PCI設(shè)備） |
| 文件頁數(shù)： | 33/284頁 |
| 文件大?。?/td> | 1042K |
| 代理商： | 62371AB |
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E
82371AB (PIIX4)
33
4/9/97 2:23 PM PIIX4aDS
INTEL CONFIDENTIAL
(until publication date)
PRELIMINARY
Name
Type
Description
SIORDY
I
SECONDARY IO CHANNEL READY.
In normal IDE mode, this input signal is directly
driven by the corresponding IDE device IORDY signal.
In an Ultra DMA/33 read cycle, this signal is used as STROBE, with the PIIX4 latching
data on rising and falling edges of STROBE. In an Ultra DMA write cycle, this signal is
used as the DMARDY# signal which is negated by the drive to pause Ultra DMA/33
transfers.
If the IDE signals are configured for Primary and Secondary, this signal is connected to
the corresponding signal on the Secondary IDE connector.
If the IDE signals are configured for Primary Master and Primary Slave, these signals
are used for the Primary Slave connector.
This is a Schmitt triggered input.
NOTES:
1.
After reset, all undefined signals on the primary channel will default to the same values as the undefined
signals on the secondary channel.
2.1.9.
UNIVERSAL SERIAL BUS SIGNALS
Name
Type
Description
OC[1:0]#
I
OVER CURRENT DETECT.
These signals are used to monitor the status of the USB
power supply lines. The corresponding USB port is disabled when its over current signal
is asserted.
USBP0+,
USBP0–
I/O
SERIAL BUS PORT 0.
This signal pair comprises the differential data signal for USB
port 0.
During Reset:
High-Z
After Reset:
High-Z
During POS:
High-Z
USBP1+,
USBP1–
I/O
SERIAL BUS PORT 1.
This signal pair comprises the differential data signal for USB
port 1.
During Reset:
High-Z
After Reset:
High-Z
During POS:
High-Z
2.1.10.
POWER MANAGEMENT SIGNALS
Name
Type
Description
BATLOW#/
GPI9
I
BATTERY LOW.
Indicates that battery power is low. PIIX4 can be programmed to
prevent a resume operation when the BATLOW# signal is asserted.
If the Battery Low function is not needed, this pin can be used as a general-purpose
input.
CPU_STP#/
GPO17
O
CPU CLOCK STOP.
Active low control signal to the clock generator used to disable
the CPU clock outputs. If this function is not needed, then this signal can be used as
a general-purpose output.
For values
During Reset
,
After Reset
, and
During POS
, see the
Suspend/Resume
and Resume Control Signaling
section.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 6259 | CONNECTOR ACCESSORY |
| 6273 | 8-BIT LATCHED DMOS POWER DRIVER |
| 6275 | 8-BIT SERIAL-INPUT, CONSTANTCURRENT LATCHED LED DRIVER |
| 6276 | 16-BIT SERIAL-INPUT, CONSTANTCURRENT LATCHED LED DRIVER |
| 6277 | 8-BIT SERIAL-INPUT, CONSTANTCURRENT LATCHED LED DRIVER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 6237201015 | 制造商:Varta 功能描述:2/3 A Series Lithium 3 V 1350 mAh With Sleeve and Wire Cylindrical Battery |
| 6237201301 | 制造商:Varta 功能描述:BATTERY LITHIUM 2/3AA PCB 3V 制造商:Varta 功能描述:BATTERY, LITHIUM, 2/3AA, PCB, 3V 制造商:Varta 功能描述:2/3 AA Lithium 3 V 1350 mAh PCB Cylindrical Battery |
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| 62372098301 | 制造商:3M Electronic Products Division 功能描述:HOT MELT ADHESIVE |
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