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參數(shù)資料
| 型號(hào)： | TSB42AB4PGE |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | IEEE 1394 A CONSUMER ELECTRONICS LINK LAYER CONTROLLER |
| 中文描述： | 1394消費(fèi)電子產(chǎn)品鏈路層控制器 |
| 文件頁數(shù)： | 34/183頁 |
| 文件大?。?/td> | 798K |
| 代理商： | TSB42AB4PGE |
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39
3.1.4.1
Register Settings for Multistrobe Host Interface
The application must use the two-wire serial interface to external EEPROM to configure these registers on
power up and reset. Table 32 lists the register bits and their functionality. See Section 6.2.2 for the values
to set in these bits.
Table 32. Multistrobe Mode Register Settings
REGISTER AND BIT NAME
MCIFCFG.MCRWISOE
PINCFG.MCRWPOL
PINCFG.MCCSZPOL
PINCFG.MCSTRBZPOL
DESCRIPTION
The host interface MCIF_RW signal operates as read (output enable) (see Note 5)
Controls the active level of the MCIF_RW pin (see Note 6).
Controls the active-level of the MCIF_CS pin.
Controls the active level of the MCIF_STRB pin. In multistrobe mode this signal is
default active-low for a write request.
4. The MCIF_STRB signal operates as write (input enable).
5. In multistrobe mode the default for a read request is active-low.
NOTES:
3.1.4.2
Connection Diagram for ceLynx Multistrobe Mode Host Interface
MCIF_CS
MCIF_ACK
MCIF_STRB
MCIF_R/W
MCIF_A[9:1]
MCIF_D[15:0]
INT
MCIF_S32
nCS0
DTACK
nWE (Write Enable)
nOE (Read Enable)
ADDR
DATA[15:0]
nINT
ceLynx Host Interface
Multistrobe Host Interface
NOTE: 32-bit accesses are also supported in (16-bit accesses) multistrobe mode.
Figure 38. Microcontroller Host Interface Connection Diagram
3.1.4.3
ceLynx Host Port Multistrobe Functional Timing
MCIF_CS
MCIF_STRB (WE)
MCIF_RW(OE)
MCIF_ACK
XXX
1F0
XXX
1F2
XXX
XXXX
0123
XXXX
4567
XXXX
MCIF_A[9:1]
MCIF_D[15:0]
Figure 39. Host Port Multistrobe Timing Write Operation
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