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參數(shù)資料
| 型號： | TSB42AB4PGE |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | IEEE 1394 A CONSUMER ELECTRONICS LINK LAYER CONTROLLER |
| 中文描述： | 1394消費(fèi)電子產(chǎn)品鏈路層控制器 |
| 文件頁數(shù)： | 100/183頁 |
| 文件大小： | 798K |
| 代理商： | TSB42AB4PGE |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁當(dāng)前第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁
63
6.2.2
SYS CFR Bit Descriptions
0x000 ID – Chip Identification Number
BIT
NAME
TYPE
RESET
FUNCTION
31:0
ID
R
731992x0
Identification – The value in this register is hardwired to
0x7319 92x0. Future revisions may be indicated by a change in
the lower byte.
This document covers the following parts/IDs:
TSB42AA4 0x7319 92C0
TSB42AB4 0x7319 92B0
0x004 PINCFG – Pin Configuration
BIT
NAME
TYPE
RESET
FUNCTION
31:28
GPIOINT1SEL
RW
F
GPIO interrupt 1 select – The binary encoded value in this register
selects one of the 10 GPIOs as the interrupt source for
SYSINT.GPIOINT1. No interrupt source is selected when any value
greater than 1001b is written to this field.
27:24
GPIOINT0SEL
RW
F
GPIO interrupt 0 select – The binary encoded value in this register
selects one of the 10 GPIOs as the interrupt source for
SYSINT.GPIOINT0. No interrupt source is selected when any value
greater than 1001b is written to this field.
23
HSDIAAVPOL
RW
1
HSDIA AV polarity – The value written to this location indicates the
active level of the associated pin. 1active high, 0active low
22
HSDIARWPOL
RW
1
HSDIA RW polarity The value written to this location indicates the
active level of the associated pin. 1active high, 0active low
21
HSDIAENPOL
RW
1
HSDIA EN polarity The value written to this location indicates the
active level of the associated pin. 1active high, 0active low
20
HSDIASYNCPOL
RW
1
HSDIA SYNC polarity The value written to this location indicates
the active level of the associated pin. 1active high, 0active low
19
HSDIBAVPOL
RW
1
HSDIB AV polarity – The value written to this location indicates the
active level of the associated pin. 1active high, 0active low
18
HSDIBRWPOL
RW
1
HSDIB RW polarity The value written to this location indicates the
active level of the associated pin. 1active high, 0active low
17
HSDIBENPOL
RW
1
HSDIB EN polarity The value written to this location indicates the
active level of the associated pin. 1active high, 0active low
16
HSDIBSYNCPOL
RW
1
HSDIB SYNC polarity The value written to this location indicates
the active level of the associated pin. 1active high, 0active low
15
ISOLATION_DIS
RW
0
Bus holder isolation disable bit – When set to 1, the bus holder
isolation for the PHY-link interface is disabled.
14:13
RSVD
R0
0
Reserved – A write to this location has no effect. A read returns 0s.
12
CONTENDEROE
RW
0
Contender output enable – Determines the direction of the
PLI_CNTDR pin on the PHY/link interface. When set to 1, the device
drives the PLI_CNTDR pin as an output. When set to 0, the
PLI_CNTDR pin is an input to the device.
11:10
RSVD
R0
0
Reserved – A write to this location has no effect. A read returns 0s.
9
MCINTZFLT
RW
1
Programmable microcontroller interrupt interrupt float When this
bit is set to 1, the microcontroller interface INTZ pin output driver is
turned off unless the signal is actively asserted.
8
MCACKZFLT
RW
1
Programmable microcontroller acknowledge float When this bit is
set to 1, the microcontroller interface MCIF_ACKZ pin output driver
is turned off when the signal is not actively asserted.
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